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參數(shù)資料
| 型號： | UPD70F3035AYGF-3BA |
| 廠商： | NEC Corp. |
| 英文描述： | V850/SB2TM 32-/16-BIT SINGLE-CHIP MICROCONTROLLERS |
| 中文描述： | V850/SB2TM 32-/16-BIT單晶片微控制器 |
| 文件頁數(shù)： | 28/56頁 |
| 文件大?。?/td> | 356K |
| 代理商： | UPD70F3035AYGF-3BA |
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Data Sheet U14780EJ1V0DS00
28
μ
PD703034A, 703034AY, 703035A, 703035AY, 70F3035A, 70F3035AY
Data Retention Characteristics (T
A
= –40 to +85°C)
Parameter
Symbol
Conditions
MIN.
TYP.
MAX.
Unit
Data retention voltage
V
DDDR
STOP mode (all functions not
operating)
3.0
Note
5.5
V
μ
PD703034A,
μ
PD703034AY,
μ
PD703035A,
μ
PD703035AY
8
70
μ
A
Data retention current
I
DDDR
V
DD
= V
DDDR
,
XT1 = V
SS
(subsystem
stopped)
μ
PD70F3035A,
μ
PD70F3035AY
8
100
μ
A
Supply voltage rise time
t
RVD
200
μ
s
Supply voltage fall time
t
FVD
200
μ
s
Supply voltage hold time
(from STOP mode setting)
t
HVD
0
ms
STOP release signal input time
t
DREL
0
ms
Data retention high-level input voltage
V
IHDR
All input ports
0.9V
DDDR
V
DDDR
V
Data retention low-level input voltage
V
ILDR
All input ports
0
0.1V
DDDR
V
Note
During STOP mode (subsystem oscillator operating), V
DD
= 3.5 to 5.5 V. Shifting to STOP mode or
restoring from STOP mode must be performed at V
DD
= 4.0 V min.
Remark
TYP. values are reference values for when T
A
= 25
°
C.
t
HVD
V
DDDR
t
DREL
V
IHDR
V
IHDR
t
FVD
t
RVD
V
DD
NMI, INTPn (input)
(Released by falling edge)
Setting STOP mode
RESET (input)
NMI, INTPn (input)
(Released by rising edge)
V
ILDR
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| UPD71054L | MOS INTEGRATED CIRCUIT |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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