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參數(shù)資料
| 型號： | UPD703100GJ-33-8EU |
| 廠商： | NEC Corp. |
| 英文描述： | V850E/MS1TM 32/16-BIT SINGLE-CHIP MICROCONTROLLERS |
| 中文描述： | V850E/MS1TM 32/16單晶片微控制器 |
| 文件頁數(shù)： | 102/132頁 |
| 文件大小： | 1174K |
| 代理商： | UPD703100GJ-33-8EU |
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Preliminary Data Sheet U14168EJ2V0DS00
102
μ
PD703100A-33, 703100A-40, 703101A-33, 703102A-33
(e) Read timing (EDO DRAM) (1/3)
Parameter
Symbol
Condition
MIN.
MAX.
Unit
Data input setup time (to CLKOUT
↑
)
<26>
t
SKID
10
ns
Data input hold time (from CLKOUT
↑
)
<27>
t
HKID
2
ns
Data output delay time from OE
↑
<37>
t
DRDOD
(0.5 + i) T – 10
ns
Row address setup time
<56>
t
ASR
(0.5 + w
RP
) T – 10
ns
Row address hold time
<57>
t
RAH
(0.5 + w
RH
) T – 10
ns
Column address setup time
<58>
t
ASC
0.5T – 10
ns
Column address hold time
<59>
t
CAH
(0.5 + w
DA
) T – 10
ns
RAS precharge time
<61>
t
RP
(0.5 + w
RP
) T – 5
ns
Column address read time (from RAS
↑
)
<64>
t
RAL
(2 + w
CP
+ w
DA
) T – 10
ns
CAS-RAS precharge time
<66>
t
CRP
(1 + w
RP
) T – 10
ns
CAS hold time
<67>
t
CSH
(1.5 + w
RH
+ w
DA
)
T –
10
ns
WE setup time (to CAS
↓
)
<68>
t
RCS
(2 + w
RP
+ w
RH
) T – 10
ns
WE hold time (from RAS
↑
)
<69>
t
RRH
0.5T – 10
ns
WE hold time (from CAS
↑
)
<70>
t
RCH
1.5T – 10
ns
RAS access time
<73>
t
RAC
(2 + w
RH
+ w
DA
)
T –
20
ns
Access time from column address
<74>
t
AA
(1.5 + w
DA
) T – 20
ns
CAS access time
<75>
t
CAC
(1 + w
DA
) T – 20
ns
Column address delay time from RAS
<76>
t
RAD
(0.5 + w
RH
) T – 10
ns
RAS-CAS delay time
<77>
t
RCD
(1 + w
RH
) T – 10
ns
Output buffer turn-off delay time (from
OE)
<78>
t
OEZ
0
ns
Access time from CAS precharge
<80>
t
ACP
(1.5 + w
CP
+ w
DA
)
T –
20
ns
CAS precharge time
<81>
t
CP
(0.5 + w
CP
) T – 5
ns
RAS hold time for CAS precharge
<83>
t
RHCP
(2 + w
CP
+ w
DA
) T – 10
ns
Read cycle time
<93>
t
HPC
(1 + w
DA
+ w
CP
) T – 10
ns
RAS pulse width
<94>
t
RASP
(2.5 + w
RH
+ w
DA
)
T –
10
ns
CAS pulse width
<95>
t
HCAS
(0.5 + w
DA
) T – 10
ns
Off-page
<96>
t
OCH1
(2 + w
RH
+ w
DA
) T – 10
ns
CAS hold time from OE
On-page
<97>
t
OCH2
(0.5 + w
DA
) T – 10
ns
Data input hold time (from CAS
↓
)
<98>
t
DHC
0
ns
Remarks 1.
T = t
CYK
2.
w
RP
: the number of waits due to the RPCxx bit of the DRCn register (n = 0 to 3, xx = 00 to 03, 10 to
13).
3.
w
RH
: the number of waits due to the RHCxx bit of the DRCn register (n = 0 to 3, xx = 00 to 03, 10 to
13).
4.
w
DA
: the number of waits due to the DACxx bit of the DRCn register (n = 0 to 3, xx = 00 to 03, 10 to
13).
5.
w
CP
: the number of waits due to the CPCxx bit of the DRCn register (n = 0 to 3, xx = 00 to 03, 10 to
13).
6.
i: the number of idle states that are inserted when a write cycle follows a read cycle.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| UPD703100AF1-33-FA1 | V850E/MS1TM 32/16-BIT SINGLE-CHIP MICROCONTROLLERS |
| UPD703100AF1-40-FA1 | V850E/MS1TM 32/16-BIT SINGLE-CHIP MICROCONTROLLERS |
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參數(shù)描述 |
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| UPD703100GJ-33-UEN-A | 制造商:Renesas Electronics Corporation 功能描述: |
| UPD703100GJ-40-8EU | 制造商:NEC 制造商全稱:NEC 功能描述:V850E/MS1TM 32/16-BIT SINGLE-CHIP MICROCONTROLLERS |
| UPD703100GJ-40-UEN | 制造商:Renesas Electronics Corporation 功能描述:MCU 32-bit V850E1 RISC ROMLess 3.3V/5V 144-Pin PQFP |
| UPD703101 | 制造商:NEC 制造商全稱:NEC 功能描述:32-Bit Single-Chip Microcontrollers |
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