參數(shù)資料
型號(hào)： UPD703100-40
廠商： NEC Corp.
英文描述： V850E/MS1TM 32/16-BIT SINGLE-CHIP MICROCONTROLLERS
中文描述： V850E/MS1TM 32/16單晶片微控制器
文件頁(yè)數(shù)： 74/132頁(yè)
文件大小： 1174K
代理商： UPD703100-40
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Preliminary Data Sheet U14168EJ2V0DS00
74
μ
PD703100A-33, 703100A-40, 703101A-33, 703102A-33
Data Hold Characteristics(T
A
= –40 to +70
°
C ...
μ
PD703100A-40,
T
A
= –40 to +85
°
C ...
μ
PD703100A-33,
μ
PD703101A-33,
μ
PD703102A-33)
Parameter
Symbol
Condition
MIN.
TYP.
MAX.
Unit
Data hold voltage
V
DDDR
STOP mode, V
DD
= V
DDDR
1.5
3.6
V
Data hold current
I
DDDR
V
DD
= V
DDDR
150
μ
A
Power supply voltage rise
time
t
RVD
200
μ
s
Power supply voltage fall time
t
FVD
200
μ
s
Power supply voltage hold
time (to STOP mode setting)
t
HVD
0
ms
STOP mode release signal
input time
t
DREL
0
ns
Data hold high-level input
voltage
V
IHDR
Note
0.8 HV
DDDR
V
DDDR
V
Data hold low-level input
voltage
V
ILDR
Note
0
0.2 V
DDDR
V
Note
P04/INTP100/DMARQ0 to P07/INTP103/DMARQ3, P14/INTP110/DMAAK0 to P17/INTP113/DMAAK3,
P34/INTP130,
P35/INTP131/SO2,
P36/INTP132/SI2,
P107/INTP123/TC3, P114/INTP140, P115/INTP141/SO3, P116/INTP142/SI3, P117/INTP143/SCK3,
P124/INTP150 to P126/INTP152, P127/INTP153/ADTRG, P02/TCLR10, P12/TCLR11, P32/TCLR13,
P102/TCLR12, P112/TCLR14, P122/TCLR15, P03/TI10, P13/TI11, P33/TI13, P103/TI12, P113/TI14,
P123/TI15, P20/NMI, P23/RXD0/SI0, P24/SCK0, P26/RXD1/SI1, P27/SCK1, MODE0 to MODE2, RESET
P37/INTP133/SCK2,
P104/INTP120/TC0
to
Remark
TYP. values are reference values for when T
A
= 25
°
C.
HV
DD
RESET (input)
V
IHDR
V
IHDR
V
ILDR
V
DD
t
HVD
t
FVD
V
DDDR
t
RVD
t
DREL
STOP mode setting
NMI (input)
(Released by falling edge)
NMI (input)
(Released by rising edge)
相關(guān)PDF資料
PDF描述
UPD703100AF1-33-FA1 V850E/MS1TM 32/16-BIT SINGLE-CHIP MICROCONTROLLERS
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UPD703100A-40 V850E/MS1TM 32/16-BIT SINGLE-CHIP MICROCONTROLLERS
uPD720114GA-YEU-A MOS INTEGRATED CIRCUIT
UPD72850A IEEE1394 400Mbps PHY
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