參數資料
型號： UPD65943
英文描述： CMOS Gate Array.Embedded Array Ver.2.0 for Package | Design Manual[05/2003]
中文描述： CMOS門陣列Array.Embedded的包版本2.0 |設計手冊[05/2003]
文件頁數： 7/64頁
文件大?。?/td> 399K
代理商： UPD65943
7
μ
PD64A, 65
Data Sheet U14380EJ2V0DS00
P-ch
N-ch
V
DD
Output
latch
Carrier
generator
data
1.2 INPUT/OUTPUT Circuits of Pins
The input/output circuits of the
μ
PD64A and 65 pins are shown in partially simplified forms below.
(1) K
I/O0
-K
I/O7
(4) S
0
(5) S
1
/LED
Note
The drive capability is held low.
(2) K
I0
-K
I3
(3) REM
(6) S
2
P-ch
N-ch
Note
N-ch
V
DD
Output
latch
Input buffer
data
output
disable
S
N-ch
Input buffer
pull-down flag
standby
release
P-ch
N-ch
N-ch
V
DD
REM
output latch
Input buffer
output
disable
standby
release
pull-down flag
N-ch
Input buffer
STOP release
ON/OFF
standby
release
OFF mode
pull-down flag
N-ch
standby
release
Input buffer
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