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參數(shù)資料
| 型號： | UPD65860-QFP160P1.2SQ |
| 英文描述： | ASIC |
| 中文描述： | 專用集成電路 |
| 文件頁數(shù)： | 19/64頁 |
| 文件大?。?/td> | 399K |
| 代理商： | UPD65860-QFP160P1.2SQ |
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19
μ
PD64A, 65
Data Sheet U14380EJ2V0DS00
4. TIMER
4.1 Timer Configuration
The timer is the block used for creating a remote control transmission pattern. As shown in Figure 4-1, it consists
of a 9-bit down counter (t
8
to t
0
), a flag (t
9
) permitting the 1-bit timer output, and a zero detecting circuit.
Figure 4-1. Timer Configuration
S
1
/LED
REM
Carrier
synchronous
circuit
Bit 2 of control register 0 (P3)
Carrier signal
Zero detecting circuit
9-bit down counter
t
9
t
8
t
7
t
6
t
5
t
4
t
3
t
2
t
1
t
0
T
T1
Bit 3 of control register 0 (P3)
f
X
/64
f
X
/128
Timer operation end signal
(HALT #
×
101B release
signal)
Count
clock
T0
S
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UPD65861-QFP120P1.2SQ | ASIC |
| UPD65891 | CMOS-N5 Family Pamphlet | Pamphlet[08/2001] |
| UPD65892 | CMOS-N5 Family Block Library Ver.5.0 | Block Library[12/2001] |
| UPD65893 | CMOS-N5 Family Design Manual Ver.6.0 | Design Manual[02/2002] |
| UPD65943 | CMOS Gate Array.Embedded Array Ver.2.0 for Package | Design Manual[05/2003] |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| UPD65861-QFP120P1.2SQ | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:ASIC |
| UPD65861-QFP160P1.2SQ | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:ASIC |
| UPD65862-QFP120P1.2SQ | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:ASIC |
| UPD65862-QFP160P1.2SQ | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:ASIC |
| UPD65863-QFP120P1.2SQ | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:ASIC |
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