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參數(shù)資料
| 型號： | UPD6454GT-101 |
| 英文描述： | On-Screen Display Circuit |
| 中文描述： | 屏幕顯示電路 |
| 文件頁數(shù)： | 37/68頁 |
| 文件大?。?/td> | 301K |
| 代理商： | UPD6454GT-101 |
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37
μ
PD63, 63A, 64
ORL A, R0n
ORL A, R1n
<1> Instruction code
<2> Cycle count
<3> Function
:
1 1 1 0 R
4
0 R
3
R
2
R
1
R
0
: 1
: (A)
←
(A)
∨
(Rmn)
CY
←
0
m = 0, 1
n = 0 to F
The accumulator contents and the register Rmn contents are ORed and the results are entered in the
accumulator.
ORL A, @R0H
ORL A, @R0L
<1> Instruction code
<2> Cycle count
<3> Function
:
1 1 1 0 0/1 1 0 0 0 0
: 1
: (A)
←
(A)
∨
(P13), (R0))
7-4
(in the case of ORL A, @R0H)
(A)
←
(A)
∨
(P13), (R0))
3-0
(in the case of ORL A, @R0L)
CY
←
0
The accumulator contents and the program memory contents specified with the control register P13 and
register pair R
10
-R
00
are ORed and the results are entered in the accumulator.
If H is specified, b
7
, b
6
, b
5
and b
4
take effect. If L is specified, b
3
, b
2
, b
1
and b
0
take effect.
ORL A, #data4
<1> Instruction code
:
1 1 1 0 1 1 0 0 0 1
0 0 0 0 0 0 d
3
d
2
d
1
d
0
: 1
: (A)
←
(A)
∨
data4
CY
←
0
<2> Cycle count
<3> Function
The accumulator contents and the immediate data are exclusive-ORed and the results are entered in
the accumulator.
XRL A, R0n
XRL A, R1n
<1> Instruction code
<2> Cycle count
<3> Function
:
1 0 1 0 R
4
0 R
3
R
2
R
1
R
0
: 1
: (A)
←
(A)
∨
(Rmn)
CY
←
A
3
Rmn
3
m = 0, 1
n = 0 to F
The accumulator contents and the register Rmn contents are ORed and the results are entered in the
accumulator.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UPD6456GS-101 | On-Screen Display Circuit |
| UPD6456GS-102 | On-Screen Display Circuit |
| UPD6456GS-103 | MARS TRANSCEIVER MODULE |
| UPD6460GT-101 | On-Screen Display Circuit |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| UPD6456GS-102 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:On-Screen Display Circuit |
| UPD6456GS-103 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:On-Screen Display Circuit |
| UPD6460G-601 | 制造商:Panasonic Industrial Company 功能描述:IC |
| UPD6460G-605 | 制造商:Panasonic Industrial Company 功能描述:IC |
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