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參數(shù)資料
| 型號： | UPD4632312AF9-B60X-BC2 |
| 廠商： | NEC Corp. |
| 英文描述： | CONNECTOR ACCESSORY |
| 中文描述： | 連接器附件 |
| 文件頁數(shù)： | 25/36頁 |
| 文件大小： | 320K |
| 代理商： | UPD4632312AF9-B60X-BC2 |
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Preliminary Data Sheet M15874EJ5V0DS
25
μ
PD4632312A-X
Figure 6-10. Write Cycle Timing Chart 4 (/LB, /UB Controlled)
t
WC
t
AS
t
WC
t
AS
A1
A2
A3
t
WR
t
WR
t
DW
t
DH
t
DW
t
DH
t
BW
t
BW
t
BP
t
BP
t
ASO
/OE (Input)
t
OHAH
t
OES
t
OEH
/CS (Input)
Address (Input)
Data In D2
I/O (Input)
High-Z
High-Z
High-Z
/WE (Input)
Data In D1
/LB, /UB (Input)
L
Cautions 1. During address transition, at least one of pins /CS and /WE, or both of /LB and /UB pins should be
inactivated.
2. Do not input data to the I/O pins while they are in the output state.
3. In write cycle, MODE and /OE should be fixed to high level.
Remark
Write operation is done during the overlap time of a low level /CS, /WE, /LB and/or /UB.
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PDF描述 |
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