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參數(shù)資料
| 型號： | UPD17072GB |
| 廠商： | NEC Corp. |
| 英文描述： | 4-BIT SINGLE-CHIP MICROCONTROLLER WITH HARDWARE FOR DIGITAL TUNING SYSTEM |
| 中文描述： | 4位單芯片的數(shù)字調(diào)諧系統(tǒng)硬件單片機 |
| 文件頁數(shù)： | 51/226頁 |
| 文件大?。?/td> | 1250K |
| 代理商： | UPD17072GB |
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51
μ
PD17072,17073
Table 8-1. Peripheral Hardware Control Functions of Peripheral Control Registers (2/4)
Peripheral
Control register
Peripheral hardware control function
At reset
hardware
Name
Address
Read/ b
3
Functional outline
Set value
Power-
Clock
CE
Write
b
2
Symbol
ON stop
b
1
b
0
0
1
PLL
PLL mode select
(BANK1)
R/W
0
Fixed to 0
0
0
R
frequency register
65H
0
synthesizer
PLLMD1
– – – – – – – – -
Sets division mode of PLL
PLLMD0
PLL reference
(BANK1)
R/W
0
Fixed to 0
0
0
R
frequency select
66H
PLLRFCK2
– – – – – – – – -
Sets reference frequency of PLL
register
PLLRFCK1
– – – – – – – – -
PLLRFCK0
PLL data register
(BANK1)
R/W
PLLR17
– – – – – – – – –
Sets division ratio of PLL
U
R
R
67H
PLLR16
– – – – – – – – –
PLLR15
– – – – – – – – –
PLLR14
(BANK1)
PLLR13
– – – – – – – – –
68H
PLLR12
– – – – – – – – –
PLLR11
– – – – – – – – –
PLLR10
(BANK1)
PLLR9
– – – – – – – – –
69H
PLLR8
– – – – – – – – –
PLLR7
– – – – – – – – –
PLLR6
(BANK1)
PLLR5
– – – – – – – – –
6AH
PLLR4
– – – – – – – – –
PLLR3
– – – – – – – – –
PLLR2
(BANK1)
PLLR1
– – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – –
6BH
0
Fixed to 0
0
0
PLL data set
(BANK1)
W
0
Fixed to 0
0
0
0
register
6CH
0
0
PLLPUT
Data transfer to programmable counter
Does not transfer Transfers
PLL unlock FF
(BANK1)
R&
0
Fixed to 0
U
R
R
register
6DH
Reset 0
0
PLLUL
Detects status of unlock FF
Locked status
Unlocked status
Note
Remark
For the details of the set value, refer to
Figure 15-4 Configuration of PLL Data Register
.
U: Undefined, R: Previous status is retained.
In direct division mode
PLLR6-PLLR17: Valid data
PLLR1-PLLR5: don’t care
0-15 (000H-00FH):
Setting prohibited
16-2
– 1 (010H-FFFH):
Can be set
In pulse swallow mode
PLLR1-PLLR17: Valid data
0-1023 (0000H-03FFH):
Setting prohibited
1024-2
– 1 (0400H-1FFFFH):
Can be set
0:1 kHz 1:3 kHz 2:5 kHz
3:6.25 kHz 4:12.5 kHz
5:25 kHz 6, 7: PLL disable
– – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – – –
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– – – – – – – – -
– – – – – – – – -
Disable
0
MF
VHF
HF
1
0
1
相關PDF資料 |
PDF描述 |
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參數(shù)描述 |
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