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參數(shù)資料
| 型號： | UPD17068GF-E |
| 廠商： | NEC Corp. |
| 英文描述： | 4-BIT SINGLE-CHIP MICROCONTROLLER CONTAINING IMAGE DISPLAY CONTROLLER AND PLL FREQUENCY SYNTHESIZER FOR DIGITAL TUNING SYSTEMS |
| 中文描述： | 4位單片機包含圖片顯示控制器和鎖相環(huán)頻率合成數(shù)字調(diào)諧系統(tǒng) |
| 文件頁數(shù)： | 194/341頁 |
| 文件大小： | 1881K |
| 代理商： | UPD17068GF-E |
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194
μ
PD17068
Remarks 1.
SIO0CH (bit 3 of serial I/O-0 mode selection register: see
Fig. 15-3
): 2-wire/3-wire system
selection
2.
SB (bit 2 of serial I/O-0 mode selection register: see
Fig. 15-3
): I
2
C bus/serial I/O selection
3.
SIO0MS (bit 1 of serial I/O-0 mode selection register: see
Fig. 15-3
): Master/slave selection
4.
SIO0TX (bit 0 of serial I/O-0 mode selection register: see
Fig. 15-3
): Receive/transmit selection
5.
SIO0CK0 and SIO0CK1 (bits 0 and 1 of serial I/O-0 clock selection register: see
Fig. 15-4
): Set
the internal shift clock frequency.
6.
SIO0WRQ0 and SIO0WRQ1 (bits 0 and 1 of serial I/O-0 wait control register: see
Fig. 15-7
):
Set the communication wait condition.
7.
SIO0NWT (bit 2 of serial I/O-0 wait control register: see
Fig. 15-7
): Sets the start of
communication.
8.
SIO0SF8 and SIO0SF9 (bits 3 and 2 of serial I/O-0 status judge register: see
Fig. 15-5
): Clock
counter detection
9.
SBSTT and SBBSY (bits 1 and 0 of serial I/O-0 status judge register: see
Fig. 15-5
): I
2
C bus
start condition, stop condition, and clock counter detection
10.
SIO0IMD0 and SIO0IMD1 (bits 0 and 1 of serial I/O-0 interrupt mode register: see
Fig. 15-8
):
Set the interrupt timing.
11.
SBACK (bit 3 of serial I/O-0 wait control register: see
Fig. 15-7
): Acknowledge data read/write
15.2.2 Clock I/O Control Block and Data I/O Control Block
The clock I/O control block and data I/O control block control the serial interface 0 communication mode
(I
2
C bus or serial I/O), the pins used (2-wire system or 3-wire system), and the transmit and receive operations.
The SIO0CH and SB flags select the 2-wire/3-wire system and I
2
C bus/serial I/O, respectively.
The SIO0MS flag selects internal clock (master)/external clock (slave) and the SIO0TX flag selects the receive
(RX)/transmit (TX) operation.
These flags are located in the serial I/O-0 mode selection register.
Fig. 15-3 shows the organization and functions of the serial I/O-0 mode selection register.
Table 15-2 shows the pin settings.
As shown in Table 15-2, to set the pins, the serial interface control flag and the I/O setting flag of each pin,
must be manipulated.
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PDF描述 |
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