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參數(shù)資料
| 型號： | UPD16681W-011 |
| 廠商： | NEC Corp. |
| 英文描述： | LCD CONTROLLER/DRIVER FOR DOT MATRIX DISPLAY OF JIS LEVEL 1 AND JIS LEVEL 2 KANJI SETS |
| 中文描述： | LCD控制器/的點陣顯示為JIS 1級和日標平驅動2漢字集 |
| 文件頁數(shù)： | 40/56頁 |
| 文件大?。?/td> | 906K |
| 代理商： | UPD16681W-011 |
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Data Sheet S13104EJ5V0DS00
40
μ
PD16681
Required timing conditions (unless otherwise specified, T
A
=
40 to +85
°
C)
Common (1) (V
DD
= 2.45 to 2.7 V)
Parameter
Symbol
Conditions
MIN.
TYP.
MAX.
Unit
Clock frequency
f
OSC
OSC
IN
external clock
180
500
kHz
High-level clock pulse width
t
WHC1
OSC
IN
external clock
600
ns
Low-level clock pulse width
t
WLC1
OSC
IN
external clock
600
ns
High-level clock pulse width
t
WHC2
OSC
BRI
external clock
400
ns
Low-level clock pulse width
t
WLC2
OSC
BRI
external clock
400
ns
Rise/fall time
tr,tf
OSC
BRI
external clock
100
ns
Reset pulse width
t
WRE
/RESET pin
50
μ
s
Reset cancellation time
t
RRE
/RESET pin
50
μ
s
Remark
The TYP. value is a reference value when T
A
= 25
°
C.
Common (2) (V
DD
= 2.7 to 3.3 V)
Parameter
Symbol
Conditions
MIN.
TYP.
MAX.
Unit
Clock frequency
f
OSC
OSC
IN
external clock
240
375
560
kHz
High-level clock pulse width
t
WHC1
OSC
IN
external clock
500
ns
Low-level clock pulse width
t
WLC1
OSC
IN
external clock
500
ns
High-level clock pulse width
t
WHC2
OSC
BRI
external clock
400
ns
Low-level clock pulse width
t
WLC2
OSC
BRI
external clock
400
ns
Rise/fall time
t
r
,t
f
OSC
BRI
external clock
100
ns
Reset pulse width
t
WRE
/RESET pin
50
μ
s
Reset cancellation time
t
RRE
/RESET pin
50
μ
s
Remark
The TYP. value is a reference value when T
A
= 25
°
C.
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
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