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參數(shù)資料
| 型號： | UDA1325PS |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | Universal Serial Bus USB CODEC |
| 中文描述： | SPECIALTY MICROPROCESSOR CIRCUIT, PDIP42 |
| 封裝： | 0.600 INCH, PLASTIC, SDIP-42 |
| 文件頁數(shù)： | 42/52頁 |
| 文件大小： | 310K |
| 代理商： | UDA1325PS |
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1999 May 10
42
Philips Semiconductors
Preliminary specification
Universal Serial Bus (USB) CODEC
UDA1325
Analog PLL (for ADC clock)
f
clk(PLL)
δ
t
strt(PO)
PLL clock frequency
duty factor
start-up time after power-on
8.1920
11.2896
50
12.2880
10
MHz
%
ms
Power-on reset
t
su(PO)
power-on set-up-time
note 1
25C
ref(2)
ms
PGA and ADC
V
i(FS)(rms)
full-scale input voltage (RMS value) PGA gain =
3 dB
1414
(3)
1000
708
355
178
89
44
20
mV
mV
mV
mV
mV
mV
mV
pF
PGA gain = 0 dB
PGA gain = 3 dB
PGA gain = 9 dB
PGA gain = 15 dB
PGA gain = 21 dB
PGA gain = 27 dB
C
i(PGA)
(THD + N)/S
input capacitance of the PGA
total harmonic distortion plus
noise-to-signal ratio
f
s
= 44.1 kHz at
input signal of
1 kHz; PGA
gain = 0 dB;
note 4
V
i
(0 dB)
1.0 V (RMS)
90
0.640
85
0.0056
30
3.2
95
100
2.0
80
0.01
20
10.0
7.04
dB
%
dB
%
dBA
dB
MHz
dBFS
V
i
(
60 dB)
S/N
α
ct
f
s
OL
signal to noise ratio
crosstalk between channels
sample frequency (128f
s
)
digital output level
V
i
= 0.0 V
PGA gain = 0 dB
PGA gain = 0 dB,
V
i
= 1 V (RMS)
SYMBOL
PARAMETER
CONDITIONS
MIN.
TYP.
MAX.
UNIT
相關PDF資料 |
PDF描述 |
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| UDA1326PS | USB AUDIO-CODEC(通用串行總線音頻編解碼器) |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
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| UDA1328T | 制造商:PHILIPS 制造商全稱:NXP Semiconductors 功能描述:Multi-channel filter DAC |
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