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參數(shù)資料
| 型號(hào)： | UDA1321 |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | USB-Digital To Analog Converters(通用串行總線-數(shù)模轉(zhuǎn)換器) |
| 中文描述： | 0.055 MHz, MICROCONTROLLER, PDIP32 |
| 文件頁數(shù)： | 32/44頁 |
| 文件大小： | 280K |
| 代理商： | UDA1321 |
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1998 Oct 06
32
Philips Semiconductors
Preliminary specification
Universal Serial Bus (USB)
Digital-to-Analog Converter (DAC)
UDA1321
SDA and SCL lines (standard I
2
C-bus);
see Fig.7
f
SCL
t
BUF
SCL clock frequency
bus free time between a STOP
and START condition
hold time (repeated) START
condition
SCL LOW time
SCL HIGH time
set-up time for a repeated START
condition
set-up time for a STOP condition
data hold time
data set-up time
rise time of both SDA and SCL
signals
fall time of both SDA and SCL
signals
load capacitance for each bus line
0
4.7
100
kHz
μ
s
t
HD;STA
4.0
μ
s
t
LOW
t
HIGH
t
SU;STA
4.7
4.0
4.7
μ
s
μ
s
μ
s
t
SU;STO
t
HD;DAT
t
SU;DAT
t
r
4.0
5.0
250
0.9
1000
μ
s
μ
s
ns
ns
t
f
300
ns
C
L(bus)
400
pF
Oscillator;
note 1
f
osc
δ
g
m
R
o
C
i(XTAL1)
C
i(XTAL2)
I
start
oscillator frequency
duty factor
transconductance
output resistance
parasitic input capacitance at XTAL1
parasitic input capacitance at XTAL2
start current
13.5
450
10
4.5
4.3
48
50
23.0
700
11
5.0
8.8
30.5
1450
12
5.5
15.0
MHz
%
mS
pF
pF
mA
Power-on reset
t
su(POR)
power-on reset set-up time
notes 2 and 3
5C
ref
ms
Filter Stream DAC (FSDAC)
RES
V
o(FS)(rms)
resolution
full-scale output voltage
(RMS value)
supply voltage ripple rejection of
V
DDA
and V
DDO
channel unbalance
crosstalk between channels
16
0.66
bits
V
V
DD
= 3.3 V
SVRR
f
ripple
= 1 kHz;
V
ripple(p-p)
= 0.1 V
maximum volume
R
L
= 5 k
60
dB
V
o
α
ct
0.03
95
dB
dB
SYMBOL
PARAMETER
CONDITIONS
MIN.
TYP.
MAX.
UNIT
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UDA1324TS | Ultra low-voltage stereo filter DAC |
| UDA1325 | Universal Serial Bus USB CODEC |
| UDA1325H | Universal Serial Bus USB CODEC |
| UDA1325PS | Universal Serial Bus USB CODEC |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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