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參數(shù)資料
| 型號： | TS68EN360VA33L |
| 廠商： | ATMEL CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-bit Quad Integrated Communication Controller |
| 中文描述： | 32-BIT, 33 MHz, RISC PROCESSOR, CQFP240 |
| 封裝： | CERAMIC, LCC-240 |
| 文件頁數(shù)： | 61/82頁 |
| 文件大?。?/td> | 874K |
| 代理商： | TS68EN360VA33L |
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61
TS68EN360
2113A–HIREL–03/02
Figure54.
IDLTimingSITransmitTimingwithDoubleSpeedClocking(DSC=1)
Notes:
1. TheratioSyncCLK/RCLK1andSyncCLK/TCLK1mustbegreaterorequalto2.25/1.
2. AlsoappliestoCDandCTSholdtimewhentheyareusedasexternalsyncsignals.
SCCinNMSIMode-externalClockElectricalSpecifications
GND=0V
DC
,T
C
=-55to+125
°
C.Theelectricalspecificationsinthisdocumentarepreliminary
(SeeFigure55toFigure57).
Number
Characteristic
25.0MHz
33.34MHz
Unit
Min
Max
Min
Max
100
(1)
RCLK1andTCLK1WidthHigh
CLKO1
-
CLKO1
-
101
RCLK1andTCLK1WidthLow
CLKO1+
5ns
-
CLKO1+
5ns
-
102
RCLK1andTCLK1Rise/FallTime
-
15
-
15
ns
103
TXD1ActiveDelay(FromTCLK1FallingEdge)
0
50
0
50
ns
104
RTS1Active/InactiveDelay(FromTCLK1FallingEdge)
0
50
0
50
ns
105
CTS1SetupTimetoTCLK1RisingEdge
40
-
40
-
ns
106
RXD1SetupTimetoRCLK1RisingEdge
40
-
40
-
ns
107
(2)
RXD1HoldTimefromRCLK1RisingEdge
0
-
0
-
ns
108
CD1SetupTimetoRCLK1RisingEdge
40
-
40
-
ns
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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