參數(shù)資料
型號： TS68EN360MR33L
廠商： ATMEL CORP
元件分類： 微控制器/微處理器
英文描述： 32-bitQuad Integrated Communication Controller
中文描述： 32-BIT, 33 MHz, RISC PROCESSOR, CPGA241
封裝： CERAMIC, PGA-241
文件頁數(shù)： 40/82頁
文件大小： 874K
代理商： TS68EN360MR33L
40
TS68EN360
2113A–HIREL–03/02
Notes:
1. Transferattributessignals=SIZx,TTx,TMx,R/WandLOCK.
2. WhenTS68040isaccessingtheinternalregisters,specification258isfromclocklownotclockhigh.
3. TheclockreferenceisEXTAL,notCLK01.TS68040InternalRegistersReadCycles
040BusTypeSlaveModeInternalRead/Write/LackCyclesACElectricalSpecifications
GND=0Vdc,T
C
=-55to+125
°
C.Theelectricalspecificationsinthisdocumentarepreliminary
(SeeFigure30toFigure33)
Number
Characteristic
25.0MHz
33.34MHz
Unit
Min
Max
Min
Max
251
(1)
Address,TransferAttributesValidtoClockLow
15
-
11.25
-
ns
252
TSLowtoClockHigh
7
-
6
-
ns
253
ClockHightoTSHigh
5
-
3
-
ns
254
ClockhightoAddress,TransferAttributesInvalid
0
-
0
-
ns
255
Data-In,MBAREValidtoClockHigh(040Write)
0
-
0
-
ns
256
ClockHightoData-In,MBAREHoldTime
0
-
0
-
ns
257
ClockHightoTA,TBILow(ExternaltoExternal)
4
20
4
15
ns
257
ClockHightoTA,TBILow(ExternaltoInternal)
4
23
4
18
ns
258
(2)(3)
ClockHightoTA,TBIHigh
4
20
4
15
ns
259
TA,TBIHightoTA,TBIHighImpedance
-
15
-
11.25
ns
260
ClockLowtoData-OutValid(040Read)
-
20
-
15
ns
262
ClockLowtoData-OutInvalid
-
20
-
15
ns
263
ClockLowtoData-OutHighImpedance
-
15
-
ns
264
ClockHightoAVECOLow
-
20
-
15
ns
265
ClockLowtoAVECOHighImpedance
-
30
-
23
ns
266
ClockLowtoIACKLow
-
30
-
23
ns
267
ClockHightoIACKHigh
-
30
-
23
ns
268
ClockLowtoAVECLow
-
30
-
23
ns
相關PDF資料
PDF描述
TS68EN360VA25L 32-bitQuad Integrated Communication Controller
TS68EN360VA33L 32-bitQuad Integrated Communication Controller
TS68HC901CFN4 HCMOS MULTI-FUNCTION PERIPHERAL
TS68HC901CFN5 HCMOS MULTI-FUNCTION PERIPHERAL
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參數(shù)描述
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