- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄373687 > TRCV012G73XE1 TRCV012G5 (2.5 Gbits/s) and TRCV012G7 (2.5 Gbits/s and 2.7 Gbits/s) Limiting Amplifier, Clock Recovery, 1:16 Data Demultiplexer PDF資料下載
參數(shù)資料
| 型號： | TRCV012G73XE1 |
| 元件分類： | 運動控制電子 |
| 英文描述： | TRCV012G5 (2.5 Gbits/s) and TRCV012G7 (2.5 Gbits/s and 2.7 Gbits/s) Limiting Amplifier, Clock Recovery, 1:16 Data Demultiplexer |
| 中文描述： | TRCV012G5（2.5 Gb /秒）和TRCV012G7（2.5 Gb /秒和2.7 Gb /秒）限幅放大器，時鐘恢復(fù)，1:16數(shù)據(jù)復(fù)用器 |
| 文件頁數(shù)： | 23/28頁 |
| 文件大小： | 500K |
| 代理商： | TRCV012G73XE1 |
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Preliminary Data Sheet
August 2000
TRCV012G5 and TRCV012G7
Limiting Amplifier, Clock Recovery, 1:16 Data Demultiplexer
23
Lucent Technologies Inc.
Timing Characteristics
Output Timing
The timing relationships between the 155 MHz or 166 MHz output clock (CK155P/N) and the output demultiplexer
data (D[15:0]P/N) and the output parity (PARITYP/N) are shown in Figure 10.
5-7726(F).fr.4
Figure 10. Transmit Timing Waveform with 155 MHz or 166 MHz Clock
The 155 MHz or 166 MHz output clock and data signals from Figure 10 are characterized in Table 17.
Table 17. LVPECL Output Pin ac Timing Characteristics
Applicable
Pins
CK155P/N
Symbol
Parameter
Conditions
Min
Typ
Max
Unit
—
Duty Cycle
155.52 MHz Clock Period
166.62 MHz Clock Period
Time Delay from Clock Edge
to D[15:0]P/N Edge
Time Delay from Clock Edge
to PARITYP/N Edge
Rise, Fall Times:
20%—80%
Transition Skew Rise to Fall
All signals
differential
48
—
—
2.9
50
6.43
6.00
3.2
52
—
—
3.9
%
ns
ns
ns
t
PERIOD
D[15:0]P/N,
PARITYP/N,
CK155P/N
t
DD1
t
DD2
3.3
4.0
4.7
ns
t
RISE
,
t
FALL
t
SKEW
200
500
800
ps
–100
0
100
ps
OUTPUT
CK155P
CK155N
OUTPUTS
D[15:0]P/N
DATA 1
t
PERIOD
DATA 2
DATA 3
PARITY 1
PARITY 2
PARITY 3
PARITYP/N
t
DD2
t
DD1
相關(guān)PDF資料 |
PDF描述 |
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