參數(shù)資料
型號(hào)： TQ2060-MC
英文描述： CPU System Clock Generator
中文描述： CPU系統(tǒng)時(shí)鐘發(fā)生器
文件頁(yè)數(shù)： 2/6頁(yè)
文件大?。?/td> 139K
代理商： TQ2060-MC
TQ2060
2
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www.triquint.com
Mode
TEST1
TEST2
TESTIN
1
REFCLK
Q, QN
1(Test)
2 (Test)
3 (Test)
4 (Bypass)
5 (Normal
0
0
1
1
1
0
1
0
1
1
f
TESTCLK
“don’t care”
f
TESTCLK
0
1
“don’t care”
“don't care”
“don't care”
f
REFCLK
f
REFCLK
f
REFCLK2
÷
20
0, 1
f
TESTCLK
÷
2
f
REFCLK
10 x f
REFCLK3
Figure 2. Simplified Block Diagram
Table 1. Mode Selection
Notes: 1. In modes 1 and 3, TESTIN may be used to bypass the PLL. A clock input at TESTIN will be divided as shown.
2. REFCLK = 35 MHz to 50 MHz.
3. Q, QN = 350 MHz to 500 MHz.
Pin 1
Q
QN
REFCLK
(from TTLoscillator)
GND
VDD
VDD
VDD
GND
GND
GND
0.1
μ
F
0.1
μ
F
0.1
μ
F
50 OHMS
Figure 3. Recommended Layout
(Not to scale)
(From TTL Oscillator)
(35MHz to
50 MHz)
Phase
Detector
÷
2
REFCLK
TESTIN
TEST1
TEST2
Q
QN
MUX
MUX
VCO
Control
÷
10
(350 MHz
to
500 MHz)
相關(guān)PDF資料
PDF描述
TQ2061-MC CPU System Clock Generator
TQ2H-L-4.5V LOW PROFILE 2 FORM C RELAY
TQ2H-L-3V LOW PROFILE 2 FORM C RELAY
TQ2H-L2-2M-9V LOW PROFILE 2 FORM C RELAY
TQ4H-L-2M-12V LOW PROFILE 2 FORM C RELAY
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