Table 6-45. Timing" />
參數(shù)資料
型號： TMX320DM365AZCE
廠商： Texas Instruments
文件頁數(shù)： 42/210頁
文件大?。?/td> 0K
描述： IC DIGITAL MEDIA SOC 338-NFBGA
標(biāo)準(zhǔn)包裝： 160
系列： TMS320DM3x, DaVinci™
類型： 數(shù)字媒體片內(nèi)系統(tǒng)（DMSoC）
接口： HPI，I²C，McBSP，MMC，SD，SPI，UART，USB
時鐘速率： 300MHz
非易失內(nèi)存： ROM（16 kB）
芯片上RAM： 32kB
電壓 - 輸入/輸出： 1.8V，3.3V
電壓 - 核心： 1.35V
工作溫度： 0°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 338-LFBGA
供應(yīng)商設(shè)備封裝： 338-NFBGA（13x13）
包裝： 托盤
其它名稱： 296-24397
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PCLK
2
1
3
4
SPRS457E
– MARCH 2009 – REVISED JUNE 2011
6.12.1.6 VPFE Electrical Data/Timing
Table 6-45. Timing Requirements for VPFE PCLK Master/Slave Mode(1) (see Figure 6-31)
NO.
MIN
MAX
UNIT
Slave Mode
8.33
120
ns
1
tc(PCLK)
Cycle time, PCLK
Master Mode
13.33
120
ns
2
tw(PCLKH)
Pulse duration, PCLK high
tc(PCLK)* 0.35
tc(PCLK)* 0.65
ns
3
tw(PCLKL)
Pulse duration, PCLK low
tc(PCLK)* 0.35
tc(PCLK)* 0.65
ns
4
tt(PCLK)
Transition time, PCLK
2
ns
(1)
P = 1/SYSCLK4 in nanoseconds (ns). For example, if the SYSCLK4 frequency is 135 MHz, use P = 7.41 ns. See Section 3.3, Device
Clocking, for more information on the supported clock configurations of the device.
Figure 6-31. VPFE PCLK Timing
Table 6-46. Timing Requirements for VPFE (ISIF) Slave Mode (see Figure 6-32)
DEVICE
UNI
NO.
T
MIN
MAX
Positive Edge
2.5
tsu(DATAV-
5
Setup time, ISIF DATA valid before PCLK edge
ns
PCLK)
Negative Edge
1.5
Positive Edge
1.5
6
th(PCLK-DATAV)
Hold time, ISIF DATA valid after PCLK edge
ns
Negative Edge
2.5
Positive Edge
2.5
7
tsu(HDV-PCLK)
Setup time, HD valid before PCLK edge
ns
Negative Edge
1.5
Positive Edge
1.5
8
th(PCLK-HDV)
Hold time, HD valid after PCLK edge
ns
Negative Edge
2.5
Positive Edge
2.5
9
tsu(VDV-PCLK)
Setup time, VD valid before PCLK edge
ns
Negative Edge
1.5
Positive Edge
1.5
10
th(PCLK-VDV)
Hold time, VD valid after PCLK edge
ns
Negative Edge
2.5
Positive Edge
2.5
tsu(C_WEV-
11
Setup time, C_WE valid before PCLK edge
ns
PCLK)
Negative Edge
1.5
Positive Edge
1.5
12
th(PCLK-C_WEV) Hold time, C_WE valid after PCLK edge
ns
Negative Edge
2.5
Positive Edge
2.5
tsu(C_FIELDV-
13
Setup time, C_FIELD valid before PCLK edge
ns
PCLK)
Negative Edge
1.5
Positive Edge
1.5
th(PCLK-
14
Hold time, C_FIELD valid after PCLK edge
ns
C_FIELDV)
Negative Edge
2.5
136
Peripheral Information and Electrical Specifications
Copyright
2009–2011, Texas Instruments Incorporated
Product Folder Link(s): TMS320DM365
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PDF描述
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TMX320DM365BZCE 功能描述:IC DIGITAL MEDIA SOC 338NFBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - DSP（數(shù)字式信號處理器） 系列:TMS320DM3x, DaVinci™ 標(biāo)準(zhǔn)包裝:2 系列:StarCore 類型:SC140 內(nèi)核 接口:DSI，以太網(wǎng)，RS-232 時鐘速率:400MHz 非易失內(nèi)存:外部 芯片上RAM:1.436MB 電壓 - 輸入/輸出:3.30V 電壓 - 核心:1.20V 工作溫度:-40°C ~ 105°C 安裝類型:表面貼裝 封裝/外殼:431-BFBGA，F(xiàn)CBGA 供應(yīng)商設(shè)備封裝:431-FCPBGA（20x20） 包裝:托盤
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TMX320DM365ZCE27F 制造商:TI 制造商全稱:Texas Instruments 功能描述:Digital Media System-on-Chip (DMSoC)
TMX320DM365ZCE30F 制造商:TI 制造商全稱:Texas Instruments 功能描述:Digital Media System-on-Chip (DMSoC)
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