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參數(shù)資料
| 型號： | TMS320V642AZDK5 |
| 廠商： | Texas Instruments, Inc. |
| 英文描述： | 1A, 52kHz (250kHz Max) Current Mode PWM Control Circuit with 8.4V UVLO Threshold and 48% Max Duty Cycle; Package: 8 LEAD PDIP; No of Pins: 8; Container: Rail; Qty per Container: 50 |
| 中文描述： | 視頻/影像定點數(shù)字信號處理器 |
| 文件頁數(shù)： | 71/123頁 |
| 文件大小： | 1205K |
| 代理商： | TMS320V642AZDK5 |
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www.ti.com
S
SPICTL.0
SPI INT FLAG
SPI INT
ENA
SPISTS.6
S
Clock
Polarity
Talk
SPICTL.1
LSPCLK
4
5
6
1
2
3
0
0
1
2
3
SPI Bit Rate
State Control
SPIRXBUF
Buffer Register
Clock
Phase
Receiver
Overrun Flag
SPICTL.4
Overrun
INT ENA
SPICCR.3 0
SPIBRR.6 0
SPICCR.6
SPICTL.3
SPIDAT.15 0
M
S
M
Master/Slave
SPISTS.7
SPIDAT
Data Register
M
S
SPICTL.2
SPI Char
SPISIMO
SPISOMI
SPICLK
SW2
S
M
M
S
SW3
To CPU
M
SW1
SPITXBUF
Buffer Register
RX FIFO _0
RX FIFO _15
16
TX FIFO registers
TX FIFO _0
16
TX FIFO _15
RX FIFO registers
16
16
TX Interrupt
Logic
RX Interrupt
Logic
SPIINT/SPIRXINT
SPITXINT
SPIFFOVF FLAG
SPIFFRX.15
TX FIFO Interrupt
RX FIFO Interrupt
SPIRXBUF
SPITXBUF
SPIFFTX.14
SPIFFENA
SPISTE
(A)
TMS320F2808, TMS320F2806
TMS320F2801, UCD9501
Digital Signal Processors
SPRS230F–OCTOBER 2003–REVISED SEPTEMBER 2005
Figure 4-14
is a block diagram of the SPI in slave mode.
A.
SPISTE is driven low by the master for a slave device.
Figure 4-14. SPI Module Block Diagram (Slave Mode)
Peripherals
71
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PDF描述 |
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| TMS320V642AZNZ6 | 制造商:Texas Instruments 功能描述:TMS320DM642A PG2 548PIN FCBGA 600MHZ - Trays |
| TMS320V642AZNZ7 | 制造商:Texas Instruments 功能描述:TMS320DM642A PG2 548PIN FCBGA 720MHZ - Trays |
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