參數資料
型號： TMS320F206PZL
元件分類： 數字信號處理
英文描述： 16-Bit Digital Signal Processor
中文描述： 16位數字信號處理器
文件頁數： 41/57頁
文件大小： 793K
代理商： TMS320F206PZL
TMS320F206
DIGITAL SIGNAL PROCESSOR
SPRS050A – NOVEMBER 1996 – REVISED APRIL 1998
41
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251–1443
timing at V
DD
= 5 V with the PLL circuit disabled, divide-by-two mode
PARAMETER
TEST CONDITIONS
MIN
MAX
UNIT
fx
Input clock frequency
TA = –40
°
C to 85
°
C, 5 V
0
40.96
MHz
This device is implemented in static logic and therefore can operate with tc(CI) approaching
∞
. The device is characterized at frequencies
approaching 0 Hz, but is tested at fx = 6.7 MHz to meet device test time requirements.
switching characteristics over recommended operating conditions (see Figure 7) [H = 0.5t
c(CO)
]
PARAMETER
’320F206-40
UNIT
MIN
TYP
MAX
tc(CO)
td(CIH-CO)
tf(CO)
tr(CO)
tw(COL)
tw(COH)
This device is implemented in static logic and therefore can operate with tc(CI) approaching
∞
. The device is characterized at frequencies
approaching 0 Hz, but is tested at tc(CI) = 300 ns to meet device test time requirements.
§Values specified from characterization data and not tested
Cycle time, CLKOUT1
48.8
2tc(CI)
ns
Delay time, CLKIN high to CLKOUT1 high/low
1
11
5§
5§
20
ns
Fall time, CLKOUT1
ns
Rise time, CLKOUT1
ns
Pulse duration, CLKOUT1 low
H – 4
H + 1
ns
Pulse duration, CLKOUT1 high
H – 3
H + 3
ns
timing requirements over recommended operating conditions (see Figure 7)
’320F206-40
MIN
UNIT
MAX
tc(CI)
tf(CI)
tr(CI)
tw(CIL)
tw(CIH)
§Values specified from characterization data and not tested
This device is implemented in static logic and therefore can operate with tc(CI) approaching
∞
. The device is characterized at frequencies
approaching 0 Hz, but is tested at a minimum tc(CI) = 150 ns to meet device test time requirements.
Cycle time, CLKIN
Fall time, CLKIN§
Rise time, CLKIN§
24.4
ns
5
ns
5
ns
Pulse duration, CLKIN low
11
ns
Pulse duration, CLKIN high
11
ns
CLKOUT1
CLKIN
tw(CIL)
tf(CI)
tw(CIH)
td(CIH-CO)
tf(CO)
tr(CO)
tc(CI)
tc(CO)
tw(COL)
tw(COH)
tr(CI)
Figure 7. CLKIN-to-CLKOUT1 Timing Without PLL (using
÷
2 clock option)
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