參數(shù)資料
型號: TMS320C6421_0711
廠商: Texas Instruments, Inc.
元件分類: 數(shù)字信號處理
英文描述: Fixed-Point Digital Signal Processor
中文描述: 定點數(shù)字信號處理器
文件頁數(shù): 171/223頁
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代理商: TMS320C6421_0711
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www.ti.com
6.11.2
I2C Electrical Data/Timing
10
8
4
3
7
12
5
6
14
2
3
13
Stop
Start
Repeated
Start
Stop
SDA
SCL
1
11
9
TMS320C6421
Fixed-Point Digital Signal Processor
SPRS346C–JANUARY 2007–REVISED NOVEMBER 2007
6.11.2.1
Inter-Integrated Circuits (I2C) Timing
Table 6-32. Timing Requirements for I2C Timings
(1)
(see
Figure 6-21
)
-4/-4Q/-4S
-5/-5Q/-5S
-6
NO.
UNIT
STANDARD
MODE
MIN
10
FAST MODE
MAX
MIN
2.5
MAX
1
t
c(SCL)
Cycle time, SCL
Setup time, SCL high before SDA low (for a repeated START
condition)
Hold time, SCL low after SDA low (for a START and a repeated
START condition)
Pulse duration, SCL low
Pulse duration, SCL high
Setup time, SDA valid before SCL high
Hold time, SDA valid after SCL low
Pulse duration, SDA high between STOP and START
conditions
Rise time, SDA
Rise time, SCL
Fall time, SDA
Fall time, SCL
Setup time, SCL high before SDA high (for STOP condition)
Pulse duration, spike (must be suppressed)
Capacitive load for each bus line
μs
2
t
su(SCLH-SDAL)
4.7
0.6
μs
3
t
h(SCLL-SDAL)
4
0.6
μs
4
5
6
7
t
w(SCLL)
t
w(SCLH)
t
su(SDAV-SCLH)
t
h(SDA-SCLL)
4.7
1.3
0.6
μs
μs
ns
μs
4
250
0
(3)
100
(2)
0
(3)
0.9
(4)
8
t
w(SDAH)
4.7
1.3
μs
9
10
11
12
13
14
15
t
r(SDA)
t
r(SCL)
t
f(SDA)
t
f(SCL)
t
su(SCLH-SDAH)
t
w(SP)
C
b(5)
1000
1000
300
300
20 + 0.1C
b(5)
20 + 0.1C
b(5)
20 + 0.1C
b(5)
20 + 0.1C
b(5)
300
300
300
300
ns
ns
ns
ns
μs
ns
pF
4
0.6
0
50
400
400
(1)
The I2C pins SDA and SCL do not feature fail-safe I/O buffers. These pins could potentially draw current when the device is powered
down.
A Fast-mode I
2
C-bus device can be used in a Standard-mode I
2
C-bus system, but the requirement t
250 ns must then be
met. This will automatically be the case if the device does not stretch the LOW period of the SCL signal. If such a device does stretch
the LOW period of the SCL signal, it must output the next data bit to the SDA line t
max + t
su(SDA-SCLH)
= 1000 + 250 = 1250 ns
(according to the Standard-mode I
2
C-Bus Specification) before the SCL line is released.
A device must internally provide a hold time of at least 300 ns for the SDA signal (referred to the V
IHmin
of the SCL signal) to bridge the
undefined region of the falling edge of SCL.
The maximum t
has only to be met if the device does not stretch the low period [t
] of the SCL signal.
C
b
= total capacitance of one bus line in pF. If mixed with HS-mode devices, faster fall-times are allowed.
(2)
(3)
(4)
(5)
Figure 6-21. I2C Receive Timings
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Peripheral Information and Electrical Specifications
171
相關(guān)PDF資料
PDF描述
TMS320C6421_07 Fixed-Point Digital Signal Processor
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TMX320DM6437AZDUA Digital Media Processor
TMX320DM6437BZDUA Digital Media Processor
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參數(shù)描述
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TMS320C6421ZDU4 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC Fixed-Pt Dig Signal Proc RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風格:SMD/SMT
TMS320C6421ZDU5 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC TMS6421 ZDU PKG 500 RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風格:SMD/SMT
TMS320C6421ZDU6 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC Fixed-Point Dig Signal Processor RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風格:SMD/SMT
TMS320C6421ZDU7 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC Fixed-Pt Dig Signal Proc RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風格:SMD/SMT