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參數(shù)資料
| 型號： | TMS320C6211GGP167 |
| 廠商： | Texas Instruments, Inc. |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | FIXED-POINT DIGITAL SIGNAL PROCESSORS |
| 中文描述： | 定點數(shù)字信號處理器 |
| 文件頁數(shù)： | 89/123頁 |
| 文件大?。?/td> | 1205K |
| 代理商： | TMS320C6211GGP167 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁當前第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁
www.ti.com
6.6
Clock Requirements and Characteristics
TMS320F2808, TMS320F2806
TMS320F2801, UCD9501
Digital Signal Processors
SPRS230F–OCTOBER 2003–REVISED SEPTEMBER 2005
Table 6-6. Input Clock Frequency
PARAMETER
Resonator (X1/X2)
Crystal (X1/X2)
MIN
20
20
TYP
MAX
UNIT
35
35
100
30
f
x
Input clock frequency
MHz
Without PLL
With PLL
4
5
External oscillator/clock
source (XCLKIN or X1 pin)
f
l
Limp mode clock frequency range
1-5
MHz
Table 6-7. XCLKIN
(1)
Timing Requirements - PLL Enabled
NO.
C8
C9
C10
C11
C12
MIN
33.3
MAX
200
UNIT
ns
ns
ns
%
%
t
c(CI)
t
f(CI)
t
r(CI)
t
w(CIL)
t
w(CIH)
Cycle time, XCLKIN
Fall time, XCLKIN
Rise time, XCLKIN
Pulse duration, XCLKIN low as a percentage of t
c(OSCCLK)
Pulse duration, XCLKIN high as a percentage of t
c(OSCCLK)
This applies to the X1 pin also.
6
6
45
45
55
55
(1)
Table 6-8. XCLKIN
(1)
Timing Requirements - PLL Disabled
NO.
C8
C9
MIN
10
MAX
250
UNIT
ns
ns
ns
ns
ns
%
%
t
c(CI)
t
f(CI)
Cycle time, XCLKIN
Fall time, XCLKIN
Up to 20 MHz
20 MHz to 100 MHz
Up to 20 MHz
20 MHz to 100 MHz
6
2
6
2
C10
t
r(CI)
Rise time, XCLKIN
C11
C12
t
w(CIL)
t
w(CIH)
Pulse duration, XCLKIN low as a percentage of t
c(OSCCLK)
Pulse duration, XCLKIN high as a percentage of t
c(OSCCLK)
This applies to the X1 pin also.
45
45
55
55
(1)
The possible configuration modes are shown in
Table 3-15
.
Table 6-9. XCLKOUT Switching Characteristics (PLL Bypassed or Enabled)
(1)(2)
NO.
C1
C3
C4
C5
C6
PARAMETER
MIN
10
TYP
MAX
UNIT
ns
ns
ns
ns
ns
cycles
t
c(XCO)
t
f(XCO)
t
r(XCO)
t
w(XCOL)
t
w(XCOH)
t
p
Cycle time, XCLKOUT
Fall time, XCLKOUT
Rise time, XCLKOUT
Pulse duration, XCLKOUT low
Pulse duration, XCLKOUT high
PLL lock time
2
2
H-2
H-2
H+2
H+2
131072t
c(OSCCLK)(3)
(1)
(2)
(3)
A load of 40 pF is assumed for these parameters.
H = 0.5t
OSCCLK is either the output of the on-chip oscillator or the output from an external oscillator.
Electrical Specifications
89
相關PDF資料 |
PDF描述 |
|---|---|
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相關代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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