參數(shù)資料
型號： TMS320C242PGS
元件分類： 數(shù)字信號處理
英文描述： 16-Bit Digital Signal Processor
中文描述： 16位數(shù)字信號處理器
文件頁數(shù)： 52/66頁
文件大小： 803K
代理商： TMS320C242PGS
TMS320C242
DSP CONTROLLER
SPRS063B – DECEMBER 1997 – REVISED DECEMBER 1999
52
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251–1443
TIMING EVENT MANAGER INTERFACE
PWM timings
PWM refers to PWM outputs on PWM1, PWM2, PWM3, PWM4, PWM5, PWM6, T1PWM, and T2PWM.
switching characteristics over recommended operating conditions for PWM timing
[H = 0.5t
c(CO)
] (see Figure 25)
PARAMETER
MIN
MAX
UNIT
tw(PWM)
td(PWM)CO
PWM outputs may be 100%, 0%, or increments of tc(CO) with respect to the PWM period.
Pulse duration, PWM output high/low
2H+5
ns
Delay time, CLKOUT low to PWM output switching
15
ns
timing requirements
[H = 0.5t
c(CO)
] (see Figure 26)
MIN
MAX
UNIT
tw(TMRDIR)
tw(TMRCLK)
twh(TMRCLK)
tc(TMRCLK)
Parameter TMRDIR is equal to the pin TDIR, and parameter TMRCLK is equal to the pin TCLKIN.
Pulse duration, TMRDIR low/high
4H+5
ns
Pulse duration, TMRCLK low as a percentage of TMRCLK cycle time
40
60
%
Pulse duration, TMRCLK high as a percentage of TMRCLK cycle time
40
60
%
Cycle time, TMRCLK
4 c(CO)
ns
tw(PWM)
td(PWM)CO
PWMx
CLKOUT
Figure 25. PWM Output Timing
CLKOUT
tw(TMRDIR)
TMRDIR
Figure 26. Capture/TMRDIR Timing
A
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PDF描述
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