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參數(shù)資料
| 型號(hào)： | TMS320C242FNS |
| 元件分類： | 數(shù)字信號(hào)處理 |
| 英文描述： | 16-Bit Digital Signal Processor |
| 中文描述： | 16位數(shù)字信號(hào)處理器 |
| 文件頁(yè)數(shù)： | 14/66頁(yè) |
| 文件大?。?/td> | 803K |
| 代理商： | TMS320C242FNS |
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TMS320C242
DSP CONTROLLER
SPRS063B – DECEMBER 1997 – REVISED DECEMBER 1999
14
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251–1443
description of shared I/O pins (continued)
Table 3. Shared Pin Configurations
PIN NO.
MUX CONTROL
REGISTER
(name.bit #)
PIN FUNCTION SELECTED
I/O PORT DATA AND DIRECTION
68-PIN
PLCC
64-PIN
QFP
(OCRx.n = 1)
(OCRx.n = 0)
REGISTER
DATA BIT
NO.
DIR BIT
NO.
§
PORT A
54
43
OCRA.0
SCITXD
IOPA0
PADATDIR
0
8
55
44
OCRA.1
SCIRXD
IOPA1
PADATDIR
1
9
66
55
OCRA.2
XINT1
IOPA2
PADATDIR
2
10
15
8
OCRA.3
CAP1/QEP0
IOPA3
PADATDIR
3
11
14
7
OCRA.4
CAP2/QEP1
IOPA4
PADATDIR
4
12
13
6
OCRA.5
CAP3
IOPA5
PADATDIR
5
13
7
64
OCRA.6
PWM1
IOPA6
PADATDIR
6
14
6
63
OCRA.7
PWM2
IOPA7
PADATDIR
7
15
PORT B
5
62
OCRA.8
PWM3
IOPB0
PBDATDIR
0
8
4
61
OCRA.9
PWM4
IOPB1
PBDATDIR
1
9
3
60
OCRA.10
PWM5
IOPB2
PBDATDIR
2
10
2
59
OCRA.11
PWM6
IOPB3
PBDATDIR
3
11
19
12
OCRA.12
T1PWM/T1CMP
IOPB4
PBDATDIR
4
12
18
11
OCRA.13
T2PWM/T2CMP
IOPB5
PBDATDIR
5
13
67
56
OCRA.14
TDIR
IOPB6
PBDATDIR
6
14
68
57
OCRA.15
TCLKIN
IOPB7
PBDATDIR
7
15
PORT C
50
39
OCRB.0
IOPC0
XF
PCDATDIR
0
8
53
56
57
58
59
11
10
42
45
46
47
48
4
3
OCRB.1
IOPC1
BIO
PCDATDIR
1
9
OCRB.2
–
IOPC2
PCDATDIR
2
10
OCRB.3
–
IOPC3
PCDATDIR
3
11
OCRB.4
–
IOPC4
PCDATDIR
4
12
OCRB.5
–
IOPC5
PCDATDIR
5
13
OCRB.6
–
IOPC6
PCDATDIR
6
14
OCRB.7
–
IOPC7
PCDATDIR
7
15
PORT D
12
5
OCRB.8
IOPD0
CLKOUT
PDDATDIR
0
8
65
54
OCRB.9
XINT2/ADCSOC
IOPD1
PDDATDIR
1
9
Valid only if the I/O function is selected on the pin
If the GPIO pin is configured as an output, these bits can be written to. If the pin is configured as an input, these bits are read from.
§If the DIR bit is 0, the GPIO pin functions as an input. For a value of 1, the pin is configured as an output.
Dedicated I/O pins
A
相關(guān)PDF資料 |
PDF描述 |
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