參數(shù)資料
型號： TMS320C203(中文)
廠商： Texas Instruments, Inc.
元件分類： 數(shù)字信號處理
英文描述： Digital Signal Processors(50ns指令周期， 空閑狀態(tài)CPU全關斷，先進的外圍，多種PLL可選)
中文描述： 數(shù)字信號處理器（50ns的指令周期，空閑狀態(tài)CPU的全關斷，先進的外圍，多種鎖相環(huán)可選）
文件頁數(shù)： 46/53頁
文件大?。?/td> 602K
代理商： TMS320C203(中文)
==1999-2-3==
P&S
oo á|′μ×ó1é· YóDT1
==53-46==
P &S
oo á|′μ×ó1é· YóDT1
μ :
ot±±ooêD×μèa· 15o
P&Sí í :
http://www.p8s.com
D :
ooêD70020D
óê±à:
430079
μ°:
( 86) ( 027￡87493500 87493506
′
( 86) ( 027) 87491166, 87493497
3. 9. 1. 3 úíμ1¤×÷ìt· §úμa 1ìD@3V [ H=0. 5t
c( co)
]
+ êyμóéìDêyYμ￡′2aê ￡
3. 9. 1. 4 úíμ1¤×÷ìt· §úμê±Dòòa ó@3V [ H=0. 5t
c( co)
]
+ êyYóéìDêyYμ￡′2aê ￡
3. 9. 2 ′′￠÷oí 2￠DDI/OóúD′ê±Dò
3yáμ±PS ￠DSoíIS′|óú3 μt
W MSH)
]ê±￡áoíD′2ù×÷· ￠éú×a±μ1y3ìía￡A15-A0 ￠PS ￠DS ￠
IS ￠RWíBRμê±Dò1μù°üà¨úòA15-A0a2μê±Dò1μD ￡
3. 9. 2. 1 úí1¤×÷ìt· §úμa 1ìD@5V [ H=0. 5t
c( cO)
]
+ êyμóéìDêyYμ￡′2aê ￡
PARAMETER
MIN
H 7
MAX
MIN
H 5
MAX
UNIT
ns
tsu(A)RD
th(A)RD
td(A)CO
th(A)CO
td(CO-RD)
td(CO-S)
tw(RDL)
tw(RDH)
td(RDW)
Setup time, address valid before RD low
Hold time, address valid after RD high
Delay time, address valid after CLKOUT1 low
6
6
ns
ns
8
8
Hold time, address valid after CLKOUT1 low
2
2
ns
Delay time, CLKOUT1 high/low to RD low/high
Delay time, CLKOUT1 low to STRB low/high
1
5
5
1
5
5
ns
ns
1
1
Pulse duration, RD low (no wait states)
Pulse duration, RD high
H 3
H 4
H + 2
H + 2
H 3
H 4
H + 2
H + 2
ns
ns
Delay time, RD high to WE low
2H 8
2H 8
MIN
MAX
2H 14
MIN
MAX
2H 14
UNIT
ns
ns
ns
ms
ns
ns
ns
ta(A)
tsu(D)RD
th(D)RD
th(D)A
tsu(DCOL)R
th(DCOL)R
ta(RD)
Access time, read data from address time
Setup time, data read before RD high
Hold time, data read from RD high
Hold time, read data from address invalid
Setup time, data read before CLKOUT1 low
Hold time, data read from CLKOUT1 low
Access time, read data after RD low
13
2
13
2
0
9
0
9
1
1
H 12
H 12
PARAMETER
'320C2XX-40
MIN
'320C2XX-57
MIN
'320C2XX-80
MIN
UNIT
MAX
MAX
MAX
tsu(A)W
th(A)W
tsu(A)CO
th(A)COw
tw(NSN)
tw(WL)
tw(WH)
td(CO-W)
td(WRD)
tsu(D)W
th(D)W
tsu(DCOL)W
th(DCOL)W
ten(D)W
Setup time, address valid before WE low
H 7
H 7
H 6
ns
Hold time, address valid after WE high
Setup time, address valid before CLKOUT1 low
H 10
H 9
H 10
H 9
H 8
H 8
ns
ns
Hold time, address valid after CLKOUT1 low
Pulse duration, IS, DS, PS inactive high
H 3
H 9
H 3
H 9
H 2
H 8
ns
ns
Pulse duration, WE low (no wait states)
2H 2
2H + 2
2H 2
2H + 2
2H 2
2H + 2
ns
Pulse duration, WE high
Delay time, CLKOUT1 low to WE low/high
2H 2
2H 2
2H 2
ns
ns
0
6
0
6
0
6
Delay time, WE high to RD low
3H 10
3H 8
3H 8
ns
Setup time, write data valid before WE high
Hold time, write data valid after WE high
2H 15
H 4
2H
H + 7
2H
H + 11
2H 15
H 4
2H
H + 7
2H
H + 11
2H 14
H 3
2H
H + 7
2H
H + 11
ns
ns
Setup time, write data valid before CLKOUT1 low
Hold time, write data valid after CLKOUT1 low
Enable time, WE to data bus driven
2H 20
H 4
2H 20
H 4
2H 20
H 5
ns
ns
4
4
3
ns
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