參數(shù)資料
型號(hào)： TMP470R1B768PGE
廠商： Texas Instruments, Inc.
英文描述： 16/32-Bit RISC Flash Microcontroller
中文描述： 16/32位RISC閃存微控制器
文件頁(yè)數(shù)： 41/50頁(yè)
文件大?。?/td> 393K
代理商： TMP470R1B768PGE
www.ti.com
SCIn ISOSYNCHRONOUS MODE TIMINGS EXTERNAL CLOCK
Timing Requirements for External Clock SCIn Isosynchronous Mode
(1)(2)
(see
Figure 17
)
TMS470R1B768
16/32-Bit RISC Flash Microcontroller
SPNS108A–AUGUST 2005–REVISED AUGUST 2006
MIN
8t
c(ICLK)
MAX
UNIT
ns
ns
ns
ns
ns
ns
ns
t
c(SCC)
t
w(SCCH)
t
w(SCCL)
t
d(SCCH-TXV)
t
v(TX)
t
su(RX-SCCL)
t
v(SCCL-RX)
Cycle time, SCInCLK
(3)
Pulse duration, SCInCLK high
Pulse duration, SCInCLK low
Delay time, SCInCLK high to SCInTX valid
Valid time, SCInTX data after SCInCLK low
Setup time, SCInRX before SCInCLK low
Valid time, SCInRX data after SCInCLK low
0.5t
c(SCC)
– 0.25t
c(ICLK)
0.5t
c(SCC)
– 0.25t
c(ICLK)
0.5t
c(SCC)
+ 0.25t
c(ICLK)
0.5t
c(SCC)
+ 0.25t
c(ICLK)
2t
c(ICLK)
+ 12 + t
r
2t
c(SCC)
– 10
0
2t
c(ICLK)
+ 10
(1)
(2)
(3)
t
= interface clock cycle time = 1/f
For rise and fall timings, see the "Switching Characteristics for Output Timings versus Load Capacitance" table.
When driving an external SCInCLK, the following must be true: t
c(SCC)
≥
8t
c(ICLK)
.
A.
Data transmission / reception characteristics for isosynchronous mode with external clocking are similar to the
asynchronous mode. Data transmission occurs on the SCICLK rising edge, and data reception occurs on the
SCICLK falling edge.
Figure 17. SCIn Isosynchronous Mode Timing Diagram for External Clock
41
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