參數資料
型號： TLC320AD50IPT
廠商： Texas Instruments, Inc.
英文描述： SIGMA-DELTA ANALOG INTERFACE CIRCUITS WITH MASTER-SLAVE FUNCTION
中文描述： sigma - delta模擬接口，具有大師電路，從功能
文件頁數： 83/84頁
文件大小： 447K
代理商： TLC320AD50IPT
E–1
Appendix E
Mechanical Data
PLASTIC J-LEADED CHIP CARRIER
FN/S-PQCC-J**
20-PIN SHOWN
4040005/A–07/93
0.048 (1,22)
0.042 (1,07)
×
45
°
1
3
19
4
8
9
13
14
18
D3/E 3
D2/E2
0.020 (0,51) MIN
0.120 (3,05) MAX
0.180 (4,57) MAX
0.050 (1,27) TYP
D
D1
E1
E
JEDEC
OUTLINE
PINS**
NO. OF
D/E
MIN
MAX
MO-047AA
20
0.385
(9,78)
0.395
(10,03)
0.350
(8,89)
0.356
(9,04)
0.456
(11,58)
0.450
(11,43)
0.495
(12,57)
0.485
(12,32)
28
MO-047AB
44
MO-047AC
52
MO-047AD
0.390
(9,91)
0.430
(10,92)
0.300
(7,62)
0.200
(5,08)
0.330
(8,38)
0.290
(7,34)
0.890
(22,61)
0.930
(23,62)
0.800
(20,32)
1.000
(25,40)
1.130
(28,70)
1.090
(27,69)
MO-047AF
84
1.185
(30,10)
1.195
(30,35)
1.150
(29,21)
1.158
(29,41)
0.956
(24,28)
0.950
(24,13)
0.995
(25,27)
0.985
(25,02)
68
MO-047AE
0.500
(12,70)
0.630
(16,00)
0.590
(14,99)
0.685
(17,40)
0.695
(17,65)
0.650
(16,51)
0.656
(16,66)
0.600
(15,24)
0.730
(18,54)
0.690
(17,53)
0.785
(19,94)
0.795
(20,19)
0.750
(19,05)
0.756
(19,20)
D2/E2
D3/E3
D1/E1
MIN
MAX
MIN
MAX
TYP
NOTES: A. All linear dimensions are in inches (millimeters).
B. This drawing is subject to change without notice.
C. Dimensions D1 and E1 do not include mold flash or protrusion. Protrusion shall not exceed 0.010 (0,25)
on any side.
D. All dimensions conform to JEDEC Specification MO-047.
E. Maximum deviation from coplanarity is 0.004 (0,10).
相關PDF資料
PDF描述
TLC320AD50(中文) Sigma-Delta Analog Interface Circuit With Master-Slave Function(Sigma-Delta 模擬接口具主從功能)
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相關代理商/技術參數
參數描述
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