參數(shù)資料
型號： SY100E193JC
廠商： Micrel Inc
文件頁數(shù)： 3/5頁
文件大小： 0K
描述： IC PARITY GENERATOR 8BIT 28PLCC
標(biāo)準(zhǔn)包裝： 38
系列： 100E
邏輯類型： 奇偶發(fā)生器
電路數(shù)： 8 位
電源電壓： 4.2 V ~ 5.5 V
工作溫度： 0°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 28-LCC（J 形引線）
供應(yīng)商設(shè)備封裝： 28-PLCC
Technical Note
3/9
www.rohm.com
2010.06 - Rev.A
2010 ROHM Co., Ltd. All rights reserved.
BD3812F
●Timing chart
1) Signal timing conditions
·Data is read on the rising edge of the clock.
·Latch is read on the falling edge of the clock.
·Latch signal must terminate with the LOW state.
* To avoid malfunctions, clock and data signals must terminate with the LOW state.
Fig.1
Parameter
Symbol
Limits
Unit
Min.
Typ.
Max.
Minimum clock width
twc
2.0
－
s
Minimum data width
twd
2.0
－
s
Minimum latch width
twl
2.0
－
s
LOW hold width
twh
2.0
－
s
Data setup time
(DATA→CLK)
tsd
1.0
－
s
Data hold time(CLK→DATA)
thd
1.0
－
s
Latch setup time(CLK→LATCH)
tsl
1.0
－
s
Latch hold time(DATA→LATCH)
thl
1.0
－
s
Latch low setup time
ts
1.0
－
s
Latch low hold time
th
1.0
－
s
2) Voltage conditions for control signal
Parameter
Condition
Limits
Unit
Min.
Typ.
Max.(≦Vcc)
“H”input voltage
Vcc=5～7.3V
VEE=-5～-7.3V
2.2
－
5.5
V
“L” input voltage
0
－
1.0
V
CL
(CLOCK)
DA
DATA
LATCH
thd
th
ts
tsl
thl
tsd
twc
twh
twd
twl
DATA
LATCH
90%
10%
90%
10%
twc
Terminate
with Low.
相關(guān)PDF資料
PDF描述
SY100E160JC IC PARITY GEN/CHKER 12BIT 28PLCC
VE-JNR-MZ-F2 CONVERTER MOD DC/DC 7.5V 25W
VE-JNR-MZ-F1 CONVERTER MOD DC/DC 7.5V 25W
VE-BTN-MV-F4 CONVERTER MOD DC/DC 18.5V 150W
VE-BTN-MV-F2 CONVERTER MOD DC/DC 18.5V 150W
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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