參數(shù)資料
型號： ST72345C4T6TR
廠商： STMICROELECTRONICS
元件分類： 微控制器/微處理器
英文描述： MICROCONTROLLER, PQFP48
封裝： 7 X 7 MM, ROHS COMPLIANT, TQFP-32
文件頁數(shù)： 22/246頁
文件大?。?/td> 2016K
代理商： ST72345C4T6TR
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On-chip peripherals
ST72344xx, ST72345xx
118/246
Figure 58.
Generic SS timing diagram
Figure 59.
Hardware/software slave select management
Master mode operation
In master mode, the serial clock is output on the SCK pin. The clock frequency, polarity and
phase are configured by software (refer to the description of the SPICSR register).
Note:
The idle state of SCK must correspond to the polarity selected in the SPICSR register (by
pulling up SCK if CPOL = 1 or pulling down SCK if CPOL = 0).
How to operate the SPI in master mode
To operate the SPI in master mode, perform the following steps in order:
1.
Write to the SPICR register:
–
Select the clock frequency by configuring the SPR[2:0] bits.
–
Select the clock polarity and clock phase by configuring the CPOL and CPHA bits.
Figure 60 shows the four possible configurations.
Note that the slave must have the same CPOL and CPHA settings as the master.
2.
Write to the SPICSR register:
–
Either set the SSM bit and set the SSI bit or clear the SSM bit and tie the SS pin
high for the complete byte transmit sequence.
3.
Write to the SPICR register:
–
Set the MSTR and SPE bits
Note that the MSTR and SPE bits remain set only if SS is high).
Note:
Important: if the SPICSR register is not written first, the SPICR register setting (MSTR bit)
may be not taken into account.
The transmit sequence begins when software writes a byte in the SPIDR register.
MOSI/MISO
Master SS
Slave SS
(if CPHA = 0)
Byte 1
Byte 2
Byte 3
1
0
SS internal
SSM bit
SSI bit
SS external pin
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