參數(shù)資料
型號(hào)： SPAKD56366PV120
廠商： MOTOROLA INC
元件分類(lèi)： 數(shù)字信號(hào)處理
英文描述： 24-BIT, 120 MHz, OTHER DSP, PQFP144
封裝： TQFP-144
文件頁(yè)數(shù)： 125/147頁(yè)
文件大小： 2156K
代理商： SPAKD56366PV120
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Specifications
Serial Host Interface SPI Protocol Timing
MOTOROLA
DSP56366 Advance Information
2-49
SERIAL HOST INTERFACE SPI PROTOCOL TIMING
Table 2-19 Serial Host Interface SPI Protocol Timing
No.
Characteristics1
Mode
Filter
Mode
Expression
Min
Max
Unit
140 Tolerable spike width on clock or data in
—
Bypassed
—
0
ns
Narrow
—
50
ns
Wide
—
100
ns
141 Minimum serial clock cycle = tSPICC(min)
Master
Bypassed
6
×TC+46
96
—
ns
Narrow
6
×TC+152
202
—
ns
Wide
6
×TC+223
273
—
ns
142 Serial clock high period
Master
Bypassed
0.5
×tSPICC –10
38
—
ns
Narrow
0.5
×tSPICC –10
91
—
ns
Wide
0.5
×tSPICC –10
126.5
—
ns
Slave
Bypassed
2.5
×TC+12
32.8
—
ns
Narrow
2.5
×TC+102
122.8
—
ns
Wide
2.5
×TC+189
209.8
—
ns
143 Serial clock low period
Master
Bypassed
0.5
×tSPICC –10
38
—
ns
Narrow
0.5
×tSPICC –10
91
—
ns
Wide
0.5
×tSPICC –10
126.5
—
ns
Slave
Bypassed
2.5
×TC+12
32.8
—
ns
Narrow
2.5
×TC+102
122.8
—
ns
Wide
2.5
×TC+189
209.8
—
ns
144 Serial clock rise/fall time
Master
—
10
ns
Slave
—
2000
ns
146
SS assertion to first SCK edge
CPHA = 0
Slave
Bypassed
3.5
×TC+15
44.2
—
ns
Narrow
0
—
ns
Wide
0
—
ns
CPHA = 1
Slave
Bypassed
10
—
ns
Narrow
0
—
ns
Wide
0
—
ns
147 Last SCK edge to SS not asserted
Slave
Bypassed
12
—
ns
Narrow
102
—
ns
Wide
189
—
ns
148 Data input valid to SCK edge (data input set-
up time)
Master/
Slave
Bypassed
0
—
ns
Narrow
MAX{(20-TC), 0}
11.7
—
ns
Wide
MAX{(40-TC), 0}
31.7
—
ns
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PDF描述
SPB3 RECTANGULAR CONNECTOR
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參數(shù)描述
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