
v
List of Illustrations
Title
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2
–
2 TAS1020A Interrupt, Reset, Suspend, and Resume Logic
2
–
3 Activation of Setup Stage Transaction Overwrite Interrupt
2
–
4 GPIO Port 1 and Port 3 Functionality
2
–
5 Codec Port Interface Parameters
–
AC
’
97 1.0
2
–
6 Codec Port Interface Parameters
–
AIC
2
–
7 Codec Port Interface Parameters
–
I
2
S
2
–
8 Byte Reversal Example
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2
–
9 Connection of the TAS1020A to an AC
’
97 Codec
2
–
10 Connection of the TAS1020A to Multiple AC
’
97 Codecs
2
–
11 Bit Transfer on the I
2
C Bus
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2
–
12 I
2
C START and STOP Conditions
2
–
13 TAS1020A Acknowledge on the I
2
C Bus
2
–
14 Single Byte Write Transfer
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2
–
15 Multiple Byte Write Transfer
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2
–
16 Single Byte Read Transfer
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2
–
17 Multiple Byte Read Transfer
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3
–
1 External Interrupt Timing Waveform
3
–
2 USB Differential Driver Timing Waveform
3
–
3 BIT_CLK and SYNC Timing Waveforms
3
–
4 SYNC, SD_IN, and SD_OUT Timing Waveforms
3
–
5 I
2
S Mode Timing Waveforms
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3
–
6 General-Purpose Mode Timing Waveforms
3
–
7 SCL and SDA Timing Waveforms
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3
–
8 Start and Stop Conditions Timing Waveforms
3
–
9 Acknowledge Timing Waveform
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
4
–
1 Typical TAS1020A Device Connections
A
–
1 Boot Loader Mode Memory Map
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
A
–
2 Normal Operating Mode Memory Map
A
–
3 USB Endpoint Configuration Blocks and Buffer Space Memory Map
Figure
2
–
1 Adaptive Clock Generator
Page
2
–
12
2
–
25
2
–
27
2
–
30
2
–
35
2
–
36
2
–
38
2
–
39
2
–
40
2
–
41
2
–
44
2
–
44
2
–
45
2
–
45
2
–
45
2
–
46
2
–
46
3
–
2
3
–
2
3
–
3
3
–
3
3
–
4
3
–
4
3
–
5
3
–
5
3
–
5
4
–
1
A
–
2
A
–
3
A
–
5
. . . . . . . . . . . . . .
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