參數(shù)資料
型號(hào)： SL28EB719AZIT
廠商： Silicon Laboratories Inc
文件頁(yè)數(shù)： 12/22頁(yè)
文件大?。?/td> 0K
描述： IC CLK CK505 TNLCK/TPCLF 48TSSOP
標(biāo)準(zhǔn)包裝： 2,000
系列： EProClock®
類型： 時(shí)鐘/頻率發(fā)生器，多路復(fù)用器
PLL： 是
主要目的： Intel CPU 服務(wù)器
輸入： 時(shí)鐘，晶體
輸出： HCSL，LVCMOS
電路數(shù)： 1
比率 - 輸入:輸出： 1:13
差分 - 輸入:輸出： 無(wú)/是
頻率 - 最大： 166.67MHz
電源電壓： 3.135 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： *
封裝/外殼： *
供應(yīng)商設(shè)備封裝： *
包裝： *
SL28EB719
DOC#: SP-AP-0005 (Rev. AB)
Page 2 of 22
48-TSSOP Pin Definitions
Pin No.
Name
Type
Description
1
NC
No Connect.
2
NC
No Connect.
3
CLKREQ#1**
I, PD
3.3V clock request input (internal 100K-ohm pull-down)
4
CLKREQ#2**
I, PD
3.3V clock request input (internal 100K-ohm pull-down)
5
PCI0 / SEL_SATA75**
I/O, SE
PD
33MHz clock output/3.3V LVTTL input to enable 75MHz SATA (internal
100K-ohm pull-down)
0 = SATA75/SRC0 = 100MHz, 1 = SATA75/SRC0 = 75MHz
6
GND_PCI
GND
Ground for PCI clocks
7
VDD_PCI
PWR
3.3V Power supply for PCI clocks
8
PCIF / ITP_EN**
I/O, SE,
PD
33 MHz free running clock output/3.3V LVTTL input to enable SRC6 or
CPU2_ITP (sampled on the CKPWRGD assertion)
0= SRC6, 1= CPU2
9
CLKREQ#3**
I, PD
3.3V clock request input (internal 100K-ohm pull-down)
10
12_48M / SEL12_48*
I/O, SE
PU
12 MHz/ 48MHz Clock output/3.3V-tolerance input for 12MHz or 48MHz
selection (Sampled at CKPWRGD assertion) (internal 100K-ohm pull-up)
0 = 48M, 1 = 12M
11
VDD_48
PWR
3.3V Power supply for 48MHz clocks
12
48M / FSA**
I/O
PD
Fixed 48 MHz clock output/3.3V-tolerant input for CPU frequency selection
(internal 100K-ohm pull-down)
Refer to DC Electrical Specifications table for Vil_FS and Vih_FS specifications.
13
GND_48
GND
Ground for 48MHz clocks
14
DOT96
O, DIF
Fixed true 96MHz clock output
15
DOT96#
O, DIF
Fixed complement 96MHz clock output
16
FSB**
I, PD
3.3V-tolerant input for CPU frequency selection (internal 100K-ohm pull-down)
Refer to DC Electrical Specifications table for Vil_FS and Vih_FS specifications.
17
GND_SATA
GND
Ground for SATA clock
18
SRC0 / SATA_75M
O, DIF
75MHz or 100MHz True differential serial reference clock
19
SRC0# / SATA_75M#
O, DIF
75MHz or 100MHz Complement differential serial reference clock
20
VDD_SATA
PWR
3.3V Power supply for SATA clock
21
SRC1
O, DIF
100MHz True differential serial reference clock
22
SRC1#
O, DIF
100MHz Complement differential serial reference clock
23
SRC2
O, DIF
100MHz True differential serial reference clock
24
SRC2#
O, DIF
100MHz Complement differential serial reference clock
25
GND_SRC
GND
Ground for SRC clocks
26
VDD_SRC
PWR
3.3V Power supply for SRC clocks
27
SRC6# / CPU2#_ITP
O, DIF
Selectable complementary differential CPU or SRC clock output.
ITP_EN = 0 @ CK_PWRGD assertion = SRC6
ITP_EN = 1 @ CK_PWRGD assertion = CPU2
28
SRC6 / CPU2_ITP,
O, DIF
Selectable True differential CPU or SRC clock output.
ITP_EN = 0 @ CK_PWRGD assertion = SRC6
ITP_EN = 1 @ CK_PWRGD assertion = CPU2
29
CPU1#
O, DIF
Complement differential CPU clock output
30
CPU1
O, DIF
True differential CPU clock output
31
VDD_CPU
PWR
3.3V Power supply for CPU clocks
32
CPU0#
O, DIF
Complement differential CPU clock output
33
CPU0
O, DIF
True differential CPU clock output
34
GND_CPU
GND
Ground for clocks
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