參數(shù)資料
型號： SL28506BZIT
廠商： Silicon Laboratories Inc
文件頁數(shù)： 26/28頁
文件大?。?/td> 0K
描述： IC CLOCK CK505 PCIE GEN2 64TSSOP
標(biāo)準(zhǔn)包裝： 2,000
類型： 時鐘/頻率發(fā)生器
PLL： 是
主要目的： Intel CPU 服務(wù)器
輸入： 時鐘，晶體
輸出： HCSL，LVCMOS
電路數(shù)： 1
比率 - 輸入:輸出： 1:22
差分 - 輸入:輸出： 無/是
頻率 - 最大： 400MHz
電源電壓： 3.135 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 64-TFSOP （0.240"，6.10mm 寬）
供應(yīng)商設(shè)備封裝： 64-TSSOP
包裝： 帶卷 (TR)
SL28506
.........................DOC #: SP-AP-0021 (Rev AA) Page 7 of 28
5
1
PCIF0_OE
Output enable for PCIF0
0 = Output Disabled, 1 = Output Enabled
4
1
PCI4_OE
Output enable for PCI4
0 = Output Disabled, 1 = Output Enabled
3
1
PCI3_OE
Output enable for PCI3
0 = Output Disabled, 1 = Output Enabled
2
1
PCI2_OE
Output enable for PCI2
0 = Output Disabled, 1 = Output Enabled
1
PCI1_OE
Output enable for PCI1
0 = Output Disabled, 1 = Output Enabled
0
1
PCI0_OE
Output enable for PCI0
0 = Output Disabled, 1 = Output Enabled
Byte 2: Control Register 2 (continued)
Bit
@Pup
Name
Description
Byte 3: Control Register 3
Bit
@Pup
Name
Description
7
1
SRC11_OE
Output enable for SRC11
0 = Output Disabled, 1 = Output Enabled
6
1
SRC10_OE
Output enable for SRC10
0 = Output Disabled, 1 = Output Enabled
5
1
SRC9_OE
Output enable for SRC9
0 = Output Disabled, 1 = Output Enabled
4
1
SRC8/ITP_OE
Output enable for SRC8 or ITP, 0 = Output Disabled, 1 = Output Enabled
3
1
SRC7_OE
Output enable for SRC7
0 = Output Disabled, 1 = Output Enabled
2
1
SRC6_OE
Output enable for SRC6
0 = Output Disabled, 1 = Output Enabled
1
SRC5_OE
Output enable for SRC5
0 = Output Disabled, 1 = Output Enabled
0
1
SRC4_OE
Output enable for SRC4
0 = Output Disabled, 1 = Output Enabled
Byte 4: Control Register 4
Bit
@Pup
Name
Description
7
1
SRC3_OE
Output enable for SRC3
0 = Output Disabled, 1 = Output Enabled
6
1
SRC2/SATA_OE
Output enable for SATA/SRC2
0 = Output Disabled, 1 = Output Enabled
5
1
SRC1_OE
Output enable for SRC
0 = Output Disabled, 1 = Output Enabled
4
1
SRC0/DOT96_OE
Output enable for SRC0/DOT96
0 = Output Disabled, 1 = Output Enabled
3
1
CPU1_OE
Output enable for CPU1
0 = Output Disabled, 1 = Output Enabled
2
1
CPU0_OE
Output enable for CPU0
0 = Output Disabled, 1 = Output Enabled
1
PLL1_SS_EN
Enable PLL1’s spread modulation,
0 = Spread Disabled 1 = Spread Enabled
0
1
PLL3_SS_EN
Enable PLL3’s spread modulation
0 = Spread Disabled, 1 = Spread Enabled
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