(VDD =
參數(shù)資料
型號： SI5110-G-BC
廠商： Silicon Laboratories Inc
文件頁數(shù)： 36/36頁
文件大小： 0K
描述： IC TXRX SERIAL/DESERIAL 99BGA
標(biāo)準(zhǔn)包裝： 176
系列： SiPHY™
類型： 收發(fā)器
驅(qū)動器/接收器數(shù)： 1/1
規(guī)程： SONET/SDH
電源電壓： 1.71 V ~ 1.89 V
安裝類型： 表面貼裝
封裝/外殼： 99-BCBGA
供應(yīng)商設(shè)備封裝： 99-CBGA（11x11）
包裝： 托盤
其它名稱： 336-1181
Si5110
Rev. 1.5
9
Table 4. AC Characteristics (TXCLK4OUT, TXCLK4IN, TXCLKOUT, TXDIN, TXDOUT)
(VDD = 1.8 V ±5%, TA = –20 to 85 °C)
Parameter
Symbol
Test Condition
Min
Typ
Max
Unit
TXCLKOUT Frequency
fclkout
2.41
—
2.7
GHz
TXCLKOUT Duty Cycle
tch/tcp, Figure 2
40
50
60
%
Output Rise Time
(TXCLKOUT, TXDOUT)
tR
—
50
75
ps
Output Fall Time
(TXCLKOUT, TXDOUT)
tF
—
50
75
ps
TXCLKOUT to TXDOUT Delay
tcd
–42
—
–22
Output Return Loss
100 kHz–2.5 GHz
2.5 GHz–4.0 GHz
—
–12
–10
—
dB
TXCLK4OUT Frequency
fCLKOUT
—
622
675
MHz
TXCLK4OUT Duty Cycle
tch/tcp, Figure 2
40
—
60
%
TXCLK4OUT Rise & Fall Times
tR,tF
100
175
250
ps
TXDIN Setup to TXCLK4IN
tDSIN
300
—
ps
TXDIN Hold from TXCLK4IN
tDHIN
300
—
ps
TXCLK4IN Frequency
fCLKIN
—
622
675
MHz
TXCLK4IN Duty Cycle
tch/tcp, Figure 2
40
—
60
%
TXCLK4IN Rise & Fall Times
tR,tF
100
—
300
ps
Table 5. AC Characteristics (Receiver PLL)
(VDD = 1.8 V ±5%, TA = –20 to 85 °C)
Parameter
Symbol
Test Condition
Min
Typ
Max
Unit
Jitter Tolerance
(RXDIN = 100 mVPPD, PRBS31)
*Note: Instrument Limited
JTOL(PP)
f = 10–600 Hz
15*
—
UIPP
f = 0.6–6 kHz
15*
—
UIPP
f = 6–100 kHz
9*
—
UIPP
f = 100 kHz–1 MHz
0.4
UIPP
f = 1–20 MHz
0.3
—
UIPP
Acquisition Time
TAQ
——
2
ms
Input Reference Clock Frequency
(REFSEL = 1)
RCFREQ
REFRATE = 1
—
155
169
MHz
REFRATE = 0
—
78
84.4
MHz
Reference Clock Duty Cycle
RCDUTY
40
50
60
%
Reference Clock Frequency
Tolerance
RCTOL
–100
—
100
ppm
Frequency Difference at which
Receive PLL goes out of Lock
(REFCLK compared to the
divided down VCO clock)
LOL
610
732
860
ppm
Frequency Difference at which
Receive PLL goes into Lock
(REFCLK compared to the
divided down VCO clock)
LOCK
—
366
240
ppm
Note: Bellcore specifications: GR-253-CORE, Issue 3, September 2000.
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