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參數(shù)資料
| 型號： | SI5018-B-GM |
| 廠商： | Silicon Laboratories Inc |
| 文件頁數(shù)： | 4/22頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLOCK/DATA RECOVERY 20-QFN |
| 標準包裝： | 75 |
| 系列： | SiPHY™, DSPLL® |
| 類型： | 時鐘和數(shù)據(jù)恢復（CDR） |
| PLL： | 是 |
| 主要目的： | SONET/SDH，ATM 應用 |
| 輸入： | 時鐘 |
| 輸出： | CML |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:2 |
| 差分 - 輸入:輸出： | 是/是 |
| 頻率 - 最大： | 2.7GHz |
| 電源電壓： | 2.375 V ~ 2.625 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 20-VFQFN 裸露焊盤 |
| 供應商設備封裝： | 20-QFN（4x4） |
| 包裝： | 管件 |
Si5018
12
Rev. 1.3
pin micro leaded package (MLP) for device ground. This
pad should be connected directly to the analog supply
pad location.
4.9. Bias Generation Circuitry
The Si5018 makes use of an external resistor to set
internal bias currents. The external resistor allows
precise generation of bias currents which significantly
reduces
power
consumption
versus
traditional
implementations that use an internal resistor. The bias
generation circuitry requires a 10 k
(1%) resistor
connected between REXT and GND.
4.10. Differential Input Circuitry
The Si5018 provides differential inputs for both the high
speed data (DIN) and the reference clock (REFCLK)
inputs. An example termination for these inputs is
shown in Figure 6. In applications where direct dc
coupling is possible, the 0.1
F capacitors may be
omitted. The DIN and REFCLK input amplifiers require
an input signal with a minimum differential peak-to-peak
voltage listed in Table 2 on page 6.
Figure 6. Input Termination for DIN and REFCLK (AC Coupled)
Figure 7. Single-Ended Input Termination for REFCLK (AC Coupled)
Dif f erential Driv er
Si5018
0.1 F
Zo = 50
Z o = 50
DIN +,
RF CLK +
DIN –,
RF CLK –
2.5 k
2. 5 k
10 k
102
VDD
GND
0.1
F
Clock
source
Si5018
0.1
F
Zo = 50
REFCLK +
REFCLK –
2.5 k
2.5 k
10 k
10 k
100
GND
VDD
102
相關PDF資料 |
PDF描述 |
|---|---|
| SI5020-B-GM | IC CLK DATA REC SONET/SDH 20-QFN |
| SI5023-D-GM | IC CLOCK/DATA RECVRY W/AMP 28MLP |
| SI52142-A01AGM | IC CLK GENERATOR 200MHZ 24QFN |
| SI52143-A01AGM | IC CLK GEN QUAD PCIE 24QFN |
| SI52144-A01AGM | IC CLK GENERATOR 100MHZ 24QFN |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| SI5018-B-GMR | 功能描述:時鐘發(fā)生器及支持產(chǎn)品 OC-48/STM-16 CDR w/FEC RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:QFN-56 |
| SI5018-BM | 功能描述:時鐘發(fā)生器及支持產(chǎn)品 SONET/SDH 2.7 Gbps OC-48 STM-16 2.5V RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:QFN-56 |
| SI5018-BMR | 功能描述:時鐘發(fā)生器及支持產(chǎn)品 SONET/SDH 2.7 Gbps OC-48 STM-16 2.5V RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:QFN-56 |
| SI5018-EVB | 功能描述:時鐘和定時器開發(fā)工具 SONET/SDH 2.7 Gbps OC-48 STM-16 2.5V RoHS:否 制造商:Texas Instruments 產(chǎn)品:Evaluation Modules 類型:Clock Conditioners 工具用于評估:LMK04100B 頻率:122.8 MHz 工作電源電壓:3.3 V |
| SI-50190-F | 制造商:Bel Fuse 功能描述:- Trays |
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