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參數資料
| 型號： | SI3230M-E-FM |
| 廠商： | Silicon Laboratories Inc |
| 文件頁數： | 12/108頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC SLIC PROG 1-CH 38QFN |
| 標準包裝： | 364 |
| 系列： | ProSLIC® |
| 功能： | 用戶線路接口概念（SLIC） |
| 接口： | SPI |
| 電路數： | 1 |
| 電源電壓： | 3.13 V ~ 5.25 V |
| 電流 - 電源： | 88mA |
| 功率（瓦特）： | 700mW |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 38-VFQFN 裸露焊盤 |
| 供應商設備封裝： | 38-QFN（5x7） |
| 包裝： | 托盤 |
| 包括： | DTMF 生成和解碼，FSK 生成 |
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Si3230
Preliminary Rev. 0.96
11
Not
Recommended
fo
r N
ew
D
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s
Figure 2. SPI Timing Diagram
Table 10. Switching Characteristics—SPI
VDDA = VDDA = 3.13 to 5.25 V, TA = 0 to 70°C for K-Grade, –40 to 85°C for B-Grade, CL = 20 pF
Parameter
Symbol
Test
Conditions
Min
Typ
Max
Unit
Cycle Time SCLK
tc
0.062
—
sec
Rise Time, SCLK
tr
—
25
ns
Fall Time, SCLK
tf
—
25
ns
Delay Time, SCLK Fall to SDO Active
td1
—
20
ns
Delay Time, SCLK Fall to SDO
Transition
td2
—
20
ns
Delay Time, CS Rise to SDO Tri-state
td3
—
20
ns
Setup Time, CS to SCLK Fall
tsu1
25
—
ns
Hold Time, CS to SCLK Rise
th1
20
—
ns
Setup Time, SDI to SCLK Rise
tsu2
25
—
ns
Hold Time, SDI to SCLK Rise
th2
20
—
ns
Delay Time between Chip Selects
(Continuous SCLK)
tcs
440
—
ns
Delay Time between Chip Selects
(Non-continuous SCLK)
tcs
220
—
ns
SDI to SDITHRU Propagation Delay
td4
—
4
10
ns
Note: All timing is referenced to the 50% level of the waveform. Input test levels are VIH = VDDD –0.4 V, VIL = 0.4 V
SCLK
CS
SDI
t
h1
t
d3
SDO
t
d1
t
d2
t
su1
t
r
t
r
t
c
t
su2
t
h2
t
cs
t
thru
相關PDF資料 |
PDF描述 |
|---|---|
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相關代理商/技術參數 |
參數描述 |
|---|---|
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| SI3230M-X-FM | 制造商:SILABS 制造商全稱:SILABS 功能描述:PROSLIC㈢ PROGRAMMABLE CMOS SLIC WITH RINGING/BATTERY VOLTAGE GENERATION |
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