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參數(shù)資料
| 型號： | SDA5250 |
| 廠商： | SIEMENS A G |
| 元件分類： | 圖文 |
| 英文描述： | ICs for Consumer Electronics |
| 中文描述： | TELETEXT AND VPS/PDC DECODER, PQCC84 |
| 文件頁數(shù)： | 108/143頁 |
| 文件大小： | 1050K |
| 代理商： | SDA5250 |
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SDA 525x
Semiconductor Group
108
1998-04-08
PWM-Enable Register PWME
PWM Compare Registers PWCOMP 0 - 5
PWM-Enable Register
Default after reset: 00
(MSB)
E7
PWME
SFR-Address F8
H
H
(LSB)
E0
E6
E5
E4
E3
E2
E1
E7 - E0
= 0
The corresponding PWM-channel is disabled. P1.i functions
as normal bidirectional I/O-port.
= 1
He corresponding PWM-channel is enabled. E0...E5 are
channels with 8-bit resolution, while E6 and E7 are channels
with 14-bit resolution.
PWM Compare Registers
Default after reset: 00
(MSB)
Bit 7
PWCOMP 0 - 5
SFR-Address F1
H
-F6
H
H
(LSB)
Bit 0
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 7 - Bit 2
This bits define the high time of the output. If all bits are 0, the
high time is 0 internal clocks. If all bits are 1, the high time is
63 internal clocks.
Bit 1
If this bit is set, every second PWM-Cycle is stretched by one
internal clock, regardless of the settings of Bit7...Bit2.
Bit 0
If this bit is set, every fourth PWM-Cycle is stretched by one
internal clock, regardless of the settings of Bit7...Bit2.
相關(guān)PDF資料 |
PDF描述 |
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