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參數(shù)資料
| 型號： | SC2200UCL-300 |
| 廠商： | ADVANCED MICRO DEVICES INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 300 MHz, MICROPROCESSOR, PBGA432 |
| 封裝： | 40 X 40 MM, 1.72 MM HEIGHT, 1.27 MM PITCH, MO-151, EBGA-432 |
| 文件頁數(shù)： | 292/449頁 |
| 文件大?。?/td> | 3921K |
| 代理商： | SC2200UCL-300 |
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AMD Geode SC2200 Processor Data Book
361
Video Processor Module - Video Processor Registers - Function 4
Revision 5.1
Offset 400h-403h
Video Processor Display Mode Register (R/W)
Reset Value: 00000000h
Selects various Video Processor modes.
31
Video FIFO Underflow (Empty).
0: No underflow has occurred.
1: Underflow has occurred.
Write 1 to reset this bit.
30
Video FIFO OverFlow (Full).
0: No overflow has occurred.
1: Overflow has occurred.
Write 1 to reset this bit.
29
Reserved. Write as read.
28
Reserved. Write as read.
27:4
Reserved. Set to 0.
3
Reserved. Write as read.
2
Reserved. Write as read.
1:0
VID_SEL (Video Select). Selects the source of the video data.
00: GX1 module.
10: VIP block.
01: Reserved.
11: Reserved.
The GX1 module’s video clock must be active at all times, regardless of the source of video input.
Offset 404h-407h
Reserved
Reset Value: 00000000h
Offset 408h-40Bh
Video Processor Test Mode Register (R/W)
Reset Value: 00000000h
31:0
Reserved.
Offset 40Ch-41Fh
Reserved
Offset 420h-423h
GenLock Register (R/W)
Reset Value: 00000000h
31:24
Reserved. Must be set to 0.
23
ODD_TO (Odd Field Time Out). Indicates CGENTO0 (F4BAR0+Memory Offset 43Ch[15:0]) has expired. This bit can be
reset by writing 1 to it.
22
EVEN_TO (Even Field Time Out). Indicates CGENTO1 (F4BAR0+Memory Offset 43Ch[31:16]) has expired. This bit can
be reset by writing 1 to it.
21:9
Reserved.
8
Reserved. Set to 0.
7
Reserved. Set to 0.
6
Reserved. Set to 0.
5
Reserved. Set to 0.
4
GENLOCK_TOUT_EN (GenLock Timeout Enable).
0: Disable.
1: Enable timeout.
3
VIP_VSYNC_EDGE_SEL (VIP VSYNC Edge Select). Selects which edge of the VSYNC signal should be synchronized
with VIP.
0: Rising edge.
1: Falling edge.
2
GX1_VSYNC_EDGE_SEL (GX1 VSYNC Edge Select). Selects which edge of the VSYNC signal should be synchronized
with the GX1 module.
0: Rising edge.
1: Falling edge.
Table 7-7. F4BAR0+Memory Offset: Video Processor Configuration Registers (Continued)
Bit
Description
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SC2200UCL-300F | 32-BIT, 300 MHz, MICROPROCESSOR, PBGA432 |
| SC26C562A8A | 2 CHANNEL(S), 10M bps, MULTI PROTOCOL CONTROLLER, PQCC52 |
| SC26C92AA1A44 | 2 CHANNEL(S), 1M bps, SERIAL COMM CONTROLLER, PQCC44 |
| SC26C92AC1F40 | 2 CHANNEL(S), 1M bps, SERIAL COMM CONTROLLER, CDIP40 |
| SC26C92AC1N40 | 2 CHANNEL(S), 1M bps, SERIAL COMM CONTROLLER, PDIP40 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| SC2200UCL-300 D3 | 制造商:Advanced Micro Devices 功能描述: |
| SC2200UCL-300 D3 | 制造商:Advanced Micro Devices 功能描述:GEO IC OPN |
| SC2200UFH-233 | 制造商:NSC 制造商全稱:National Semiconductor 功能描述:Thin Client On a Chip |
| SC2200UFH-233B D3 | 制造商:Advanced Micro Devices 功能描述: |
| SC2200UFH-266 | 制造商:NSC 制造商全稱:National Semiconductor 功能描述:Thin Client On a Chip |
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