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參數(shù)資料
| 型號： | SATMEGA32A-ANR |
| 廠商： | ATMEL CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, FLASH, 16 MHz, RISC MICROCONTROLLER, PQFP44 |
| 封裝： | 10 X 10 MM, 1 MM HEIGHT, 0.80 MM PITCH, GREEN, PLASTIC, MS-026ACB, TQFP-44 |
| 文件頁數(shù)： | 322/353頁 |
| 文件大?。?/td> | 5149K |
| 代理商： | SATMEGA32A-ANR |
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70
8155C–AVR–02/11
ATmega32A
low level interrupt is selected, the low level must be held until the completion of the currently
executing instruction to generate an interrupt.
Bit 1, 0 – ISC01, ISC00: Interrupt Sense Control 0 Bit 1 and Bit 0
The External Interrupt 0 is activated by the external pin INT0 if the SREG I-flag and the corre-
sponding interrupt mask are set. The level and edges on the external INT0 pin that activate the
interrupt are defined in Table 13-2. The value on the INT0 pin is sampled before detecting
edges. If edge or toggle interrupt is selected, pulses that last longer than one clock period will
generate an interrupt. Shorter pulses are not guaranteed to generate an interrupt. If low level
interrupt is selected, the low level must be held until the completion of the currently executing
instruction to generate an interrupt.
13.1.2
MCUCSR – MCU Control and Status Register
Bit 6 – ISC2: Interrupt Sense Control 2
The Asynchronous External Interrupt 2 is activated by the external pin INT2 if the SREG I-bit and
the corresponding interrupt mask in GICR are set. If ISC2 is written to zero, a falling edge on
INT2 activates the interrupt. If ISC2 is written to one, a rising edge on INT2 activates the inter-
rupt. Edges on INT2 are registered asynchronously. Pulses on INT2 wider than the minimum
pulse width given in Table 13-3 will generate an interrupt. Shorter pulses are not guaranteed to
generate an interrupt. When changing the ISC2 bit, an interrupt can occur. Therefore, it is rec-
ommended to first disable INT2 by clearing its Interrupt Enable bit in the GICR Register. Then,
Table 13-1.
Interrupt 1 Sense Control
ISC11
ISC10
Description
0
The low level of INT1 generates an interrupt request.
0
1
Any logical change on INT1 generates an interrupt request.
1
0
The falling edge of INT1 generates an interrupt request.
1
The rising edge of INT1 generates an interrupt request.
Table 13-2.
Interrupt 0 Sense Control
ISC01
ISC00
Description
0
The low level of INT0 generates an interrupt request.
0
1
Any logical change on INT0 generates an interrupt request.
1
0
The falling edge of INT0 generates an interrupt request.
1
The rising edge of INT0 generates an interrupt request.
Bit
7
6543
210
JTD
ISC2
–
JTRF
WDRF
BORF
EXTRF
PORF
MCUCSR
Read/Write
R/W
R
R/W
Initial Value
0
See Bit Description
相關PDF資料 |
PDF描述 |
|---|---|
| SAW04A0A | SINGLE COLOR LED, COOL WHITE |
| SAX-XC878-13FFI3V3 | 8-BIT, FLASH, 24 MHz, RISC MICROCONTROLLER, PQFP64 |
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| SAX-XC878CM-13FFI5V | 8-BIT, FLASH, 24 MHz, RISC MICROCONTROLLER, PQFP64 |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| SAT-MX-10-R | 制造商:3M Electronic Products Division 功能描述:SAT-MX-10-R SLIC STUBBED AERIA 80611319551 制造商:3M Electronic Products Division 功能描述:SLIC STUBBED AERIAL TERMINAL 10 PR UNPROT MX2000 RIGHT ENTRY |
| SAT-MXP-10-L | 制造商:3M Electronic Products Division 功能描述:SLIC STUBBED AERIAL TERMINAL 10 PR MX2000 PROT LEFT ENTRY |
| SATP4032G-CMM | 制造商:PRETEC 功能描述:DRIVESSD 32GB 2.5" SATA IIP4000 MLC |
| SATP4128G-CMM | 制造商:PRETEC 功能描述:DRIVESSD 128GB 2.5" SATA IIP4000 MLC |
| SATP4256G-CMM | 制造商:PRETEC 功能描述:DRIVESSD 256GB 2.5" SATA IIP4000 MLC |
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