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參數資料
| 型號： | SAF82525N |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 英文描述： | Data Communications ICs |
| 中文描述： | 數據通信集成電路 |
| 文件頁數： | 17/126頁 |
| 文件大?。?/td> | 730K |
| 代理商： | SAF82525N |
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Semiconductor Group
17
82525
82526
82525
82526
SAB
SAB
SAF
SAF
1.2 System Integration
General Aspects
Figure 2
gives a general overview of the system integration of HSCX.
Figure 2
General System Integration of HSCX
The HSCX bus interface consists of an 8-bit bidirectional data bus (D0–D7), seven address
line inputs (A0–A6), three control inputs (RD/DS, WR/R/W, CS), one interrupt request output
(INT) and a 4-channel DMA interface (DRQTA, DRQRA, DACKA, DRQTB, DRQRB, DACKB).
Mode input pins (strapping options) allow the bus interface to be configured for either Siemens/
Intel or Motorola environment.
Generally, there are two types of transfers occurring via the system bus:
– command/status transfers, which are always controlled by the CPU. The CPU sets the
operation mode (initialization), controls function sequences and gets status information by
writing or reading the HSCX’s registers (via CS, WR or RD, and register address via A0-A6).
– data transfers, which are effectively performed by DMA without CPU interaction using the
HSCX’s DMA interface (DMA mode). Optionally, interrupt controlled data transfer can be
done by the CPU (interrupt mode).
Memory
CPU
CS
System Bus
HSCX
DATA
DRQTA,
DRQTB,
DMA
Controller
C
S
Serial
Channel
INT
ITS00947
A
B
Channel
Serial
DRQRA,
DRQRB,
DACKA
DACKB
相關PDF資料 |
PDF描述 |
|---|---|
| SAF82526 | Data Communications ICs |
| SAF82526N | Data Communications ICs |
| SAB82525 | Data Communications ICs |
| SAB82525H | Data Communications ICs |
| SAF82532H-10 | ICs for Communications |
相關代理商/技術參數 |
參數描述 |
|---|---|
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