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參數(shù)資料
| 型號： | S9S08LG32J0VLK |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 25/50頁 |
| 文件大小： | 0K |
| 描述： | IC MCU 8BIT 32KB FLASH 80LQFP |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 系列： | S08 |
| 核心處理器： | S08 |
| 芯體尺寸： | 8-位 |
| 速度： | 40MHz |
| 連通性： | I²C，LIN，SCI，SPI |
| 外圍設(shè)備： | LCD，LVD，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 69 |
| 程序存儲器容量： | 32KB（32K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 1.9K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.7 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 16x12b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 105°C |
| 封裝/外殼： | 80-LQFP |
| 包裝： | 托盤 |
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Electrical Characteristics
MC9S08LG32 Series Data Sheet, Rev. 9
Freescale Semiconductor
31
2.11.3
SPI Timing
Table 16. SPI Timing
No.
C
Function
Symbol
Min
Max
Unit
—
D
Operating frequency
Master
Slave
fop
fBus/2048
0
fBus/2
fBus/4
Hz
D
SPSCK period
Master
Slave
tSPSCK
2
4
2048
—
tcyc
D
Enable lead time
Master
Slave
tLead
1
2
1
—
tSPSCK
tcyc
D
Enable lag time
Master
Slave
tLag
1
2
1
—
tSPSCK
tcyc
D
Clock (SPSCK) high or low time
Master
Slave
tWSPSCK
tcyc –30
tcyc – 30
1024 tcyc
—
ns
D
Data setup time (inputs)
Master
Slave
tSU
15
—
ns
D
Data hold time (inputs)
Master
Slave
tHI
0
25
—
ns
D
Slave access time
ta
—1
tcyc
D
Slave MISO disable time
tdis
—1
tcyc
D
Data valid (after SPSCK edge)
Master
Slave
tv
—
25
ns
D
Data hold time (outputs)
Master
Slave
tHO
0
—
ns
D
Rise time
Input
Output
tRI
tRO
—
tcyc – 25
25
ns
D
Fall time
Input
Output
tFI
tFO
—
tcyc – 25
25
ns
1
2
3
4
5
6
7
8
9
10
11
12
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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