參數(shù)資料
型號： S912XDG256J1MAL
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 16-BIT, FLASH, 40 MHz, MICROCONTROLLER, PQFP112
封裝： LEAD FREE, LQFP-112
文件頁數(shù)： 522/1000頁
文件大?。?/td> 3287K
代理商： S912XDG256J1MAL
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Chapter 13 Freescale’s Scalable Controller Area Network (S12MSCANV3)
MC9S12XDP512 Data Sheet, Rev. 2.13
568
Freescale Semiconductor
13.3.2.3
MSCAN Bus Timing Register 0 (CANBTR0)
The CANBTR0 register congures various CAN bus timing parameters of the MSCAN module.
Read: Anytime
Write: Anytime in initialization mode (INITRQ = 1 and INITAK = 1)
2
WUPM
Wake-Up Mode — If WUPE in CANCTL0 is enabled, this bit denes whether the integrated low-pass lter is
applied to protect the MSCAN from spurious wake-up (see Section 13.4.5.4, “MSCAN Sleep Mode”).
0 MSCAN wakes up on any dominant level on the CAN bus
1 MSCAN wakes up only in case of a dominant pulse on the CAN bus that has a length of Twup
1
SLPAK
Sleep Mode Acknowledge — This ag indicates whether the MSCAN module has entered sleep mode (see
Section 13.4.5.4, “MSCAN Sleep Mode”). It is used as a handshake ag for the SLPRQ sleep mode request.
Sleep mode is active when SLPRQ = 1 and SLPAK = 1. Depending on the setting of WUPE, the MSCAN will
clear the ag if it detects activity on the CAN bus while in sleep mode.
0 Running — The MSCAN operates normally
1 Sleep mode active — The MSCAN has entered sleep mode
0
INITAK
Initialization Mode Acknowledge — This ag indicates whether the MSCAN module is in initialization mode
(see Section 13.4.5.5, “MSCAN Initialization Mode”). It is used as a handshake ag for the INITRQ initialization
mode request. Initialization mode is active when INITRQ = 1 and INITAK = 1. The registers CANCTL1,
CANBTR0, CANBTR1, CANIDAC, CANIDAR0–CANIDAR7, and CANIDMR0–CANIDMR7 can be written only by
the CPU when the MSCAN is in initialization mode.
0 Running — The MSCAN operates normally
1 Initialization mode active — The MSCAN has entered initialization mode
Module Base + 0x0002
76543210
R
SJW1
SJW0
BRP5
BRP4
BRP3
BRP2
BRP1
BRP0
W
Reset:
00000000
Figure 13-6. MSCAN Bus Timing Register 0 (CANBTR0)
Table 13-3. CANBTR0 Register Field Descriptions
Field
Description
7:6
SJW[1:0]
Synchronization Jump Width — The synchronization jump width denes the maximum number of time quanta
(Tq) clock cycles a bit can be shortened or lengthened to achieve resynchronization to data transitions on the
CAN bus (see Table 13-4).
5:0
BRP[5:0]
Baud Rate Prescaler — These bits determine the time quanta (Tq) clock which is used to build up the bit timing
(see Table 13-5).
Table 13-2. CANCTL1 Register Field Descriptions (continued)
Field
Description
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