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參數(shù)資料
| 型號： | S3C880AXX-AQ |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | MROM, 8 MHz, MICROCONTROLLER, PDIP42 |
| 封裝： | 0.600 INCH, SDIP-42 |
| 文件頁數(shù)： | 43/242頁 |
| 文件大小： | 1313K |
| 代理商： | S3C880AXX-AQ |
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S3C880A/F880A
I/O PORTS
9-5
PORT 2
Port 2 is a bit-programmable general I/O port. Port 2 is accessed directly by writing or reading the port 2 data
register, P2 (E2H, set 1, bank 0). The upper byte (P2.4–P2.7) and the lower byte (P2.0–P2.3) are controlled by
the P2CONH and P2CONL registers, respectively.
A reset clears the port 2 control registers to '00H', configuring the port 2 pins to normal input mode (P2.0–P2.3)
and input mode (2.4–P2.7). You use P2CONH and P2CONL register settings to configure individual port 2 pins:
Port 2 Control Register, High Byte (P2CONH)
E8H, Set 1, Bank 0, R/W
LSB
MSB
.7
.6
.5
.4
.3
.2
.1
.0
P2.4/PWM4
P2CONH Pin Configuration Settings:
00
01
10
11
Input mode
N-channel open-drain output mode (5V load capacity)
Push-pull output mode
P2.4: PWM4 output mode (open-drain type)
P2.5: PWM5 output mode (push-pull circuit type)
P2.6: Timer 0 output mode (PWM or Interval; open-drain type)
P2.7: OSD half-tone output mode (push-pull circuit type)
P2.5/PWM0
P2.6/T0
P2.7/OSDHT
Figure 9-6. Port 2 High-Byte Control Register (P2CONH)
Port 2 Control Register, Low Byte (P2CONL)
E9H, Set 1, Bank 0, R/W
LSB
MSB
.7
.6
.5
.4
.3
.2
.1
.0
P2.0/PWM5
P2CONL Pin Configuration Settings:
00
01
10
11
Normal input mode
N-channel open-drain output mode with 5V load capacity
PWM output mode: N-channel open-drain type
Push-pull output mode
P2.1/PWM1
P2.2/PWM2
P2.3/PWM3
Figure 9-7. Port 2 Low-Byte Control Register (P2CONL)
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