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參數(shù)資料
| 型號(hào)： | R5F64179HDFD |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 64-BIT, FLASH, MICROCONTROLLER, PQFP144 |
| 封裝： | 20 X 20 MM, 0.50 MM PITCH, PLASTIC, LQFP-144 |
| 文件頁(yè)數(shù)： | 103/114頁(yè) |
| 文件大?。?/td> | 851K |
| 代理商： | R5F64179HDFD |
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REJ03B0254-0110
Rev.1.10
Page 89 of 111
Jun 23, 2010
R32C/117 Group
5. Electrical Characteristics
VCC =5V
Timing Requirements (VCC = 4.2 to 5.5 V, VSS = 0 V, and Ta =Topr, unless otherwise noted)
Note:
1.
The value is calculated by the following formulas based on a value SSC set by bits SSC4 to SSC0 in
the I2CSSCR register:
th(SDA-SCL)S = SSC ÷ 2 × tc(φIIC) + 40 [ns]
tsu(SCL-SDA)P = (SSC ÷ 2 + 1) × tc(φIIC) + 40 [ns]
tw(SDAH)P = (SSC + 1) × tc(φIIC) + 40 [ns]
Table 5.34
Multi-master I2C-bus Interface
Symbol
Characteristic
Value
Unit
Standard-mode
Fast-mode
Min.
Max.
Min.
Max.
tw(SCLH)
MSCL input high level pulse width
600
ns
tw(SCLL)
MSCL input low level pulse width
600
ns
tr(SCL)
MSCL input rise time
1000
300
ns
tf(SCL)
MSCL input fall time
300
ns
tr(SDA)
MSDA input rise time
1000
300
ns
tf(SDA)
MSDA input fall time
300
ns
th(SDA-SCL)S
MSCL high level hold time after start
condition/restart condition
(1)
2 × tc(φIIC) + 40
ns
tsu(SCL-SDA)P
MSCL high level setup time for
restart condition/stop condition
(1)
2 × tc(φIIC) + 40
ns
tw(SDAH)P
MSDA high level pulse width after
stop condition
(1)
4 × tc(φIIC) + 40
ns
tsu(SDA-SCL)
MSDA input setup time
100
ns
th(SCL-SDA)
MSDA input hold time
00
ns
相關(guān)PDF資料 |
PDF描述 |
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