參數(shù)資料
型號(hào)： R5F101FAAFP#V0
廠商： Renesas Electronics America
文件頁數(shù)： 180/395頁
文件大?。?/td> 0K
描述： MCU 16BIT 16KB FLASH 44LQFP
產(chǎn)品培訓(xùn)模塊： RL78 ADC
標(biāo)準(zhǔn)包裝： 1
系列： RL78/G13
核心處理器： RL78
芯體尺寸： 16-位
速度： 32MHz
連通性： CSI，I²C，LIN，UART/USART
外圍設(shè)備： DMA，POR，PWM，WDT
輸入/輸出數(shù)： 31
程序存儲(chǔ)器容量： 16KB（16K x 8）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 2K x 8
電壓 - 電源 (Vcc/Vdd)： 1.65 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 10x8/10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 44-LQFP
包裝： 托盤
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2005 Microchip Technology Inc.
DS39612B-page 259
PIC18F6525/6621/8525/8621
24.0
SPECIAL FEATURES OF THE CPU
There are several features intended to maximize
system reliability, minimize cost through elimination of
external components, provide power-saving operating
modes and offer code protection. These are:
Oscillator Selection
Reset
- Power-on Reset (POR)
- Power-up Timer (PWRT)
- Oscillator Start-up Timer (OST)
- Brown-out Reset (BOR)
Interrupts
Watchdog Timer (WDT)
Sleep
Code Protection
ID Locations
In-Circuit Serial Programming
All PIC18F6525/6621/8525/8621 devices have a
Watchdog Timer which is permanently enabled via the
configuration bits, or software controlled. It runs off its
own RC oscillator for added reliability. There are two
timers that offer necessary delays on power-up. One is
the Oscillator Start-up Timer (OST), intended to keep
the chip in Reset until the crystal oscillator is stable.
The other is the Power-up Timer (PWRT) which
provides a fixed delay on power-up only, designed to
keep the part in Reset while the power supply
stabilizes. With these two timers on-chip, most
applications need no external Reset circuitry.
Sleep mode is designed to offer a very low current
power-down mode. The user can wake-up from Sleep
through external Reset, Watchdog Timer wake-up, or
through an interrupt. Several oscillator options are also
made available to allow the part to fit the application.
The RC oscillator option saves system cost, while the
LP crystal option saves power. A set of configuration
bits is used to select various options.
24.1
Configuration Bits
The configuration bits can be programmed (read as ‘0’)
or left unprogrammed (read as ‘1’), to select various
device configurations. These bits are mapped, starting
at program memory location 300000h.
The user will note that address 300000h is beyond the
user program memory space. In fact, it belongs to the
configuration
memory
space
(300000h
through
3FFFFFh) which can only be accessed using table
reads and table writes.
Programming the Configuration registers is done in a
manner similar to programming the Flash memory. The
EECON1 register WR bit starts a self-timed write to the
Configuration register. In normal operation mode, a
TBLWT
instruction, with the TBLPTR pointed to the
Configuration register, sets up the address and the
data for the Configuration register write. Setting the WR
bit starts a long write to the Configuration register. The
Configuration registers are written a byte at a time. To
write or erase a configuration cell, a TBLWT instruction
can write a ‘1’ or a ‘0’ into the cell.
TABLE 24-1:
CONFIGURATION BITS AND DEVICE IDS
File Name
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Default/
Unprogrammed
Value
300001h
CONFIG1H
—
—OSCSEN
—
FOSC3
FOSC2
FOSC1
FOSC0
--1- 1111
300002h
CONFIG2L
—
BORV1
BORV0
BOR
PWRTEN
---- 1111
300003h
CONFIG2H
—
WDTPS3 WDTPS2 WDTPS1
WDTPS0
WDTEN
---1 1111
300004h(1) CONFIG3L
WAIT
—
—PM1
PM0
1--- --11
300005h
CONFIG3H
MCLRE
—
—ECCPMX(1)
CCP2MX
1--- --11
300006h
CONFIG4L
DEBUG
—
—LVP
—STVREN
1--- -1-1
300008h
CONFIG5L
—
—CP3(2)
CP2
CP1
CP0
---- 1111
300009h
CONFIG5H
CPD
CPB
—
11-- ----
30000Ah
CONFIG6L
—
—WRT3(2)
WRT2
WRT1
WRT0
---- 1111
30000Bh
CONFIG6H
WRTD
WRTB
WRTC
—
111- ----
30000Ch
CONFIG7L
—
—EBTR3(2)
EBTR2
EBTR1
EBTR0
---- 1111
30000Dh
CONFIG7H
—EBTRB
—
-1-- ----
3FFFFEh
DEVID1
DEV2
DEV1
DEV0
REV4
REV3
REV2
REV1
REV0
(Note 3)
3FFFFFh
DEVID2
DEV10
DEV9
DEV8
DEV7
DEV6
DEV5
DEV4
DEV3
0000 1010
Legend:
x
= unknown, u = unchanged, – = unimplemented. Shaded cells are unimplemented, read as ‘0’.
Note
1:
Unimplemented in PIC18F6525/6621 devices; maintain this bit set.
2:
Unimplemented in PIC18FX525 devices; maintain this bit set.
3:
See Register 24-13 for DEVID1 values.
相關(guān)PDF資料
PDF描述
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