參數(shù)資料
型號: QLU2108-PQ208C
英文描述: Telecommunication IC
中文描述: 通信集成電路
文件頁數(shù): 10/22頁
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代理商: QLU2108-PQ208C
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www.quicklogic.com
2001 QuickLogic Corporation
QLUX2108-PQ208C Device Data Sheet
6.0 Global Signal Distribution
The externally provided Utopia Transmit and Receive clocks are connected to global
resources to provide low skew and fast chip level distribution. In both data directions, the
two corresponding Utopia Interfaces are decoupled by asynchronous FIFOs.
Therefore each interface runs completely independently each at its own tx and rx clocks
which typically are up to 50 MHz on the WEST and up to 25 MHz on the EAST interface.
The Error indications of the two receive interfaces are always sampled within the west clock
domains. The errors of the east rx interface is available on the erx_err signal, which is
handled using the west clock domain (wrxclk). The west tx (receiving) error is directly
derived from the west tx block (wtxclk).
Figure 6: Slave/Master Bridge Clock Distribution
相關PDF資料
PDF描述
QLU22108-PT280C Telecommunication IC
QLUM2208-PQ208C Telecommunication IC
QLUM2208-PT280C Telecommunication IC
QLUM2216-PQ208C Telecommunication IC
QLUM2216-PT280C Telecommunication IC
相關代理商/技術(shù)參數(shù)
參數(shù)描述
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