參數(shù)資料
型號(hào)： QL6250E-6PS484M
廠商： QUICKLOGIC CORP
元件分類(lèi)： FPGA
英文描述： FPGA, 960 CLBS, 248160 GATES, PBGA484
封裝： 23 X 23 MM, 1 MM PITCH, MS-034AAJ-1, PLASTIC, BGA-484
文件頁(yè)數(shù)： 3/64頁(yè)
文件大?。?/td> 850K
代理商： QL6250E-6PS484M
2006 QuickLogic Corporation
Eclipse-E Family Data Sheet Rev. A
11
Programmable Slew Rate
Each I/O has programmable slew rate capability—the slew rate can be either fast or slow. The slower rate can
be used to reduce the switching times of each I/O.
Programmable Weak Pull-Down
A programmable Weak Pull-Down resistor is available on each I/O. The I/O Weak Pull-Down eliminates the
need for external pull down resistors for used I/Os as shown in Figure 9. The spec for pull-down current is
maximum of 150
μA under worst case condition.
Figure 9: Programmable I/O Weak Pull-Down
I/O Output Logic
PAD
相關(guān)PDF資料
PDF描述
QL6250E-7PQ208C FPGA, 960 CLBS, 248160 GATES, PQFP208
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QL6250E-7PQ208M FPGA, 960 CLBS, 248160 GATES, PQFP208
QL6250E-7PS484C FPGA, 960 CLBS, 248160 GATES, PBGA484
QL6250E-7PS484I FPGA, 960 CLBS, 248160 GATES, PBGA484
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參數(shù)描述
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