參數(shù)資料
型號： PT7C4511
英文描述： PLL Clock Multiplier?
中文描述： PLL時(shí)鐘倍頻？
文件頁數(shù)： 5/7頁
文件大?。?/td> 164K
代理商： PT7C4511
Data Sheet
PT7C4501/4501A Frequency Multiplier
PT0139(12/03)
Ver:0
5
|||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
AC Electrical Characteristics (Vcc = 3.3V unless otherwise noted)
Sym.
Parameter
Test Condition
Part
No.
Pin
Min.
Typ.
Max.
Unit
f
IN
Input Frequency
crystal
ICLK
5
30
MHz
V
CC
: 3.0 to 5.5V
4501
CLK
20
180
f
OUT
Output frequency
V
CC
: 3.0 to 5.5V
4501A
CLK
20
150
MHz
t
r
Output clock rise time
0.8 to 2.0V
CLK
1
ns
t
f
Output clock fall time
2.0 to 0.8V
CLK
1
ns
V
CC
: 3V, up to 120MHz
Duty Output clock duty cycle
At
V
CC
/2
V
CC
: 5V, up to 150MHz
CLK
45
50
55
%
PLL bandwidth
*
10
kHz
Output enable time
OE high to output on
15
50
ns
Output disable time
OE low to tri-state
15
50
ns
Period Jitter
70MHz~200MHz, 25C
CLK
50
100
ps
Jitter over 200ns interval 100MH~200MHz, 25C
CLK
200
ps
* Note:
only reference for design.
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