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參數(shù)資料
| 型號： | PSD501B1-C-70L |
| 廠商： | 意法半導體 |
| 英文描述： | Low Cost Field Programmable Microcontroller Peripherals |
| 中文描述： | 低成本現(xiàn)場可編程微控制器外圍設備 |
| 文件頁數(shù)： | 106/153頁 |
| 文件大?。?/td> | 1036K |
| 代理商： | PSD501B1-C-70L |
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PSD5XX Famly
103
The Page Register is 4 bits wide and consists of four D flip flops.The outputs of the Register
(PGR0 – PGR3) are connected to the input bus of the ZPLD. By including the four outputs
as inputs to the DPLD, the addressing capability of the microcontroller is increased by a
factor of 16.
Figure 49 shows the Page Register block diagram. Inputs to the four flip flops are connected
to data bus D0-D3. The output of the Register can be read by the microcontroller. The
Register can operate as an independent register to the microcontroller if page mode is not
implemented.
Figure 49. Page Register
DPLD
RS0
GPLD
PPLD
ZPLD
ES0 – 3
PGR0
PGR1
PGR2
PGR3
R/W
D0
D0 – D3
D1
D2
D3
Q0
Q1
Q2
Q3
PAGE
REGISTER
RESET
The PSD5XX has a programmable security bit which offers protection from unauthorized
duplication. When the security bit is set, the contents of the EPROM, the PSD5XX
non-volatile configuration bits and ZPLD data are prevented from being read by EPROM
programmers.
The security bit is set through the PSDsoft Software and is embedded in the compiled
output file. The security bit is UV erasable and a secured part can be erased and then
re-programmed.
10.0
Page
Register
11.0
Security
Protection
相關PDF資料 |
PDF描述 |
|---|---|
| PSD511B1-C-70L | Low Cost Field Programmable Microcontroller Peripherals |
| PSD501B1-C-70U | Low Cost Field Programmable Microcontroller Peripherals |
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| PSD611E1 | Field Programmable Microcontroller Peripherals with Embedded Micro--Cell(可編程邏輯，4K位SRAM,26個可編程I/O,通用PLD有63個輸入) |
相關代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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