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參數(shù)資料
| 型號(hào)： | PSD312R |
| 英文描述： | Field Programmable Microcontroller Peripherals(可編程邏輯,無SRAM,4位頁寄存器,19個(gè)可編程I/O,通用PLD有16個(gè)輸入) |
| 中文描述： | 現(xiàn)場可編程微控制器外圍設(shè)備（可編程邏輯，無SRAM，4個(gè)位頁寄存器，19個(gè)可編程的I / O，通用PLD的有16個(gè)輸入） |
| 文件頁數(shù)： | 28/127頁 |
| 文件大小： | 682K |
| 代理商： | PSD312R |
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PSD3XX Famly
2-28
Table 13.
Internal States
During
Power-Down
Component
Signals
Contents
CS0–CS10
All 1’s (deselected)
PAD
CSADIN, CSADOUT1,
CSADOUT2, CSIOPORT,
RS0, ES0–ES7
All 0’s (deselected)
Data register A
Direction register A
Data register B
Direction register B
n/a
n/a
n/a
n/a
All
unchanged
Figure 12.
A19/CSI Cell
Structure
CADLOG3
CONF.
BIT
ADDRESS
LATCH
CSI (POWER-UP SIGNAL)
A19
TO PAD
CADDHLT
CONFIGURATION
BIT: LATCH OR
TRANSPARENT
CONTROL
(NOTE 24)
ALE
CR19/CSI
CONF.
BIT
A19/CSI
TO PAD, EPROM, SRAM,
PORTS, LATCHES, ETC.
ADDRESS INDICATOR
TO EPROM
NOTES:
24. The CADDHLT configuration bit determines if A19–A16 are transparent via the latch,
or if they must be latched by the trailing edge of the ALE strobe.
25. In the PSD3X1, the CATD configuration bit performs this function for all the A16–A19
lines.
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參數(shù)描述 |
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