2010-2012 Microchip Technology Inc. DS39977F-page 379 PIC18F66K80 FAMILY 24.6 Comparator Interrupts Th" />
參數(shù)資料
型號： PIC18LF6310-I/PT
廠商： Microchip Technology
文件頁數(shù)： 311/411頁
文件大?。?/td> 0K
描述： IC PIC MCU FLASH 4KX16 64TQFP
產(chǎn)品培訓模塊： Asynchronous Stimulus
8-bit PIC® Microcontroller Portfolio
標準包裝： 160
系列： PIC® 18F
核心處理器： PIC
芯體尺寸： 8-位
速度： 40MHz
連通性： I²C，SPI，UART/USART
外圍設備： 欠壓檢測/復位，HLVD，POR，PWM，WDT
輸入/輸出數(shù)： 54
程序存儲器容量： 8KB（4K x 16）
程序存儲器類型： 閃存
RAM 容量： 768 x 8
電壓 - 電源 (Vcc/Vdd)： 2 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 12x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 64-TQFP
包裝： 托盤
產(chǎn)品目錄頁面： 642 (CN2011-ZH PDF)
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2010-2012 Microchip Technology Inc.
DS39977F-page 379
PIC18F66K80 FAMILY
24.6
Comparator Interrupts
The comparator interrupt flag is set whenever any of
the following occurs:
Low-to-high transition of the comparator output
High-to-low transition of the comparator output
Any change in the comparator output
The comparator interrupt selection is done by the
EVPOL<1:0>
bits
in
the
CMxCON
register
(CMxCON<4:3>).
In order to provide maximum flexibility, the output of the
comparator may be inverted using the CPOL bit in the
CMxCON register (CMxCON<5>). This is functionally
identical to reversing the inverting and non-inverting
inputs of the comparator for a particular mode.
An interrupt is generated on the low-to-high or high-to-
low transition of the comparator output. This mode of
interrupt generation is dependent on EVPOL<1:0> in
the CMxCON register. When EVPOL<1:0> = 01 or 10,
the interrupt is generated on a low-to-high or high-to-
low transition of the comparator output. Once the
interrupt is generated, it is required to clear the interrupt
flag by software.
When EVPOL<1:0> = 11, the comparator interrupt flag
is set whenever there is a change in the output value of
either comparator. Software will need to maintain
information about the status of the output bits, as read
from CMSTAT<7:6>, to determine the actual change
that occurred.
The CMPxIF<2:0> (PIR4<5:4) bits are the Comparator
Interrupt Flags. The CMPxIF bits must be reset by
clearing them. Since it is also possible to write a ‘1’ to
this register, a simulated interrupt may be initiated.
Table 24-2 shows the interrupt generation with respect
to comparator input voltages and EVPOL bit settings.
Both the CMPxIE bits (PIE4<5:4>) and the PEIE bit
(INTCON<6>) must be set to enable the interrupt. In
addition, the GIE bit (INTCON<7>) must also be set. If
any of these bits are clear, the interrupt is not enabled,
though the CMPxIF bits will still be set if an interrupt
condition occurs.
A simplified diagram of the interrupt section is shown in
TABLE 24-2:
COMPARATOR INTERRUPT GENERATION
Note:
CMPxIF
will
not
be
set
when
EVPOL<1:0> = 00.
CPOL
EVPOL<1:0>
Comparator
Input Change
CxOUT Transition
Interrupt
Generated
0
00
VIN+ > VIN-
Low-to-High
No
VIN+ < VIN-High-to-Low
No
01
VIN+ > VIN-
Low-to-High
Yes
VIN+ < VIN-High-to-Low
No
10
VIN+ > VIN-
Low-to-High
No
VIN+ < VIN-High-to-Low
Yes
11
VIN+ > VIN-
Low-to-High
Yes
VIN+ < VIN-High-to-Low
Yes
1
00
VIN+ > VIN-High-to-Low
No
VIN+ < VIN-
Low-to-High
No
01
VIN+ > VIN-High-to-Low
No
VIN+ < VIN-
Low-to-High
Yes
10
VIN+ > VIN-High-to-Low
Yes
VIN+ < VIN-
Low-to-High
No
11
VIN+ > VIN-High-to-Low
Yes
VIN+ < VIN-
Low-to-High
Yes
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PDF描述
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